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2025年8月1日

A3P250 spi 从机 LED 控制逻辑

摘要: A3P250 spi 从机, 主机发送指令控制 LED , 0x55 关闭 LED, 0x AA 打开 LED; module led( clk_40mhz, rst_n, led_1, spi_cs_n, spi_clk, spi_mosi, gpio_95, gpio_94, gpio_93 ) 阅读全文

posted @ 2025-08-01 16:00 所长 阅读(21) 评论(0) 推荐(0)

A3P250 复位信号测试

摘要: 测试 OK! module led( clk_40mhz, rst_n, led_1 ); input clk_40mhz; // pin62 input rst_n; // pin64 output led_1; // pin13 reg led_reg; reg [31:0] tick_cnt 阅读全文

posted @ 2025-08-01 13:59 所长 阅读(9) 评论(0) 推荐(0)

A3P250 verilog LED 闪烁

摘要: module led( clk_40mhz, led_1 ); input clk_40mhz; // pin62 output led_1; // pin13 reg led_reg; reg [31:0] tick_cnt = 32'd0; always @(posedge clk_40mhz) 阅读全文

posted @ 2025-08-01 13:50 所长 阅读(10) 评论(0) 推荐(0)

2025年7月30日

spi_slave.v":36:1:36:6|Logic for led_reg does not match a standard flip-flop

摘要: 代码按照下面这么写,编译报错:spi_slave.v":36:1:36:6|Logic for led_reg does not match a standard flip-flop module spi_slave( output wire led_1, // pin_129 / 2.5V out 阅读全文

posted @ 2025-07-30 21:42 所长 阅读(42) 评论(0) 推荐(0)

verilog spi slave 错误记录三

摘要: 加上 spi_clk , 使用 gpio 观察 代码 执行逻辑 !!! /////////////////////////////////////////////////////////////////////////////////////////////////// // Company: <N 阅读全文

posted @ 2025-07-30 21:24 所长 阅读(17) 评论(0) 推荐(0)

verilog spi slave 错误记录二

摘要: 使用 cs 引脚 触发 , 使用 gpio0 输出触发信号,使用 逻辑分析仪 观察输出信号, 了解 FPGA 工作逻辑!!! 我觉得这个功能 ,类似 C代码的 printf 啊 !!! ///////////////////////////////////////////////////////// 阅读全文

posted @ 2025-07-30 20:52 所长 阅读(13) 评论(0) 推荐(0)

zynq verilog 编写 spi slave 代码 错误记录 一

摘要: `timescale 1ns / 1ps module spi_slave( input wire spi_clk_0, // spi_cs input wire spi_clk_1, // spi_clk input wire spi_mosi, output wire spi_miso, out 阅读全文

posted @ 2025-07-30 09:23 所长 阅读(37) 评论(0) 推荐(0)

2025年7月28日

zynq ps 端 spi emio

摘要: 1、 不要整个 extern, 对于主机来讲, 只是引出 对应的 4根 引脚即可,例如: 存在 毛刺的现象, 项目后期有时间 ,再来解决 这个问题; 阅读全文

posted @ 2025-07-28 12:30 所长 阅读(182) 评论(0) 推荐(0)

2025年7月25日

kicad 9.0.3 生成 BOM 物料清单

摘要: 1、kicad 更新太快了, 当前使用版本 V9.0.3 2、在工程页面,文件→新建作业集文件 3、选择 生成 物料清单 4、选择 编辑页面, 选择输出的字段,打对号就可以, 选择 按照 那个字段进行分组, 我是按照 数值来分组; 5、选择 导出 页面, 选择 导出格式 点击 保存即可; 6、 右下 阅读全文

posted @ 2025-07-25 10:21 所长 阅读(303) 评论(0) 推荐(1)

2025年7月22日

ZYNQ AXI UARTLite v2.0 中断触发逻辑

摘要: 1、 使用 官方 提供的 库, 太繁琐了; 2、手写寄存器 ,编程 , 发现 就 4个寄存器,非常简单 ,定义如下 : 官方手册:https://docs.amd.com/v/u/en-US/pg142-axi-uartlite 3、 什么情况下 会触发中断 Interrupt Control - 阅读全文

posted @ 2025-07-22 14:16 所长 阅读(271) 评论(0) 推荐(0)

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