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2025年8月24日

SmartFusion2 and IGLOO2 Programming

摘要: UG0451: SmartFusion2 and IGLOO2 Programming User Guide 1、JTAG 编程 使用外部编程器,JTAG协议, 对设备编程; 比如 FLASH PRO5 使用外部MCU运行 DirectC 代码, 模拟 JTAG 协议,对设备进行编程, Direct 阅读全文

posted @ 2025-08-24 16:37 所长 阅读(193) 评论(0) 推荐(0)

smartfusion2 softconsole hardfault

摘要: 1、按照 SoftConsole v4.0 and Libero SoC v11.7 新建工程 2、main 函数里 ,只有 GPIO 初始化函数 3、仿真进入直接 hardfault 4、 调试 日志 fpServer v17 waiting for incoming connections on 阅读全文

posted @ 2025-08-24 12:51 所长 阅读(34) 评论(0) 推荐(0)

2025年8月23日

smartfusion2 Embedded Flash (ENVM) Configuration

摘要: 写这篇笔记的目的是找到 libero 自带的 flash pro 工具 能擦除 smartfusion2 的 envm 擦除! 但是很遗憾没有找到! 问题已解决,SmartFusion2 使用 libero 烧录 softconsole 编译的 HEX 文件 到 eNVM 的方法 - 所长 - 博客 阅读全文

posted @ 2025-08-23 09:27 所长 阅读(93) 评论(0) 推荐(0)

2025年8月18日

ZYNQ QSPI FLASH 双堆叠 dual ss 4-bit stacked I/O 的 用法

摘要: 1、共用总线方式框图 2、需要设置 PS GPIO_0 作为 QSPI1_SS_B 信号, 寄存器 对应 0xF8000700 写入 0x1602,记得 unlock SLCR寄存器,否则无法写入0xF8000700! 3、 重点: 配置 QSPI 的 LQSPI CR 寄存器 , 使能 2块 FL 阅读全文

posted @ 2025-08-18 12:01 所长 阅读(162) 评论(0) 推荐(0)

2025年8月13日

A3P250 开发板 PCB 开源设计

摘要: 1、开源地址 https://gitee.com/SU0ZHANG/a3p250_kfb 2、资源如下 1、A3P250 100个引脚全部引出2、40Mhz 有源晶振输入3、复位电路,按键复位4、一路用户 按键5、一路 可控 LED6、一路 电源指示灯7、一路 QSPI FLASH8、一路 EEPR 阅读全文

posted @ 2025-08-13 17:03 所长 阅读(38) 评论(0) 推荐(0)

2025年8月6日

ZYNQ 不能启动 原因 查找

摘要: 总结: 1、使用JTAG不能连接ARM,不能,确认电源、时钟、复位、BOOT引脚状态! 2、JTAG能连接ARM,读取 BOOT mode 寄存器(保存了上电复位读取的引脚状态),确认启动方式,是否是自己的启动方式,PLL锁定状态,读取错误状态寄存器,确认错误原因; BOOT MODE: 地址: 0 阅读全文

posted @ 2025-08-06 22:48 所长 阅读(313) 评论(0) 推荐(0)

2025年8月5日

ProASIC 3 FPGAs A3P250 JTAG Debug Interface

摘要: The Microsemi FlashPro3 programmer, which is used to program the FPGA and debug the Cortex-M1 core using SoftConsole, uses a standard 10-pin JTAG inte 阅读全文

posted @ 2025-08-05 09:06 所长 阅读(21) 评论(0) 推荐(0)

2025年8月4日

verilog 看门狗 实现

摘要: // SPI 发送 0xC0 看门狗禁用 // SPI 发送 0xC1 看门狗使能 // SPI 发送 0xC2 看门狗清除 always @(posedge clk_40mhz or negedge rst_n) begin if (!rst_n) begin watch_dog_en <= 1' 阅读全文

posted @ 2025-08-04 20:22 所长 阅读(30) 评论(0) 推荐(0)

2025年8月3日

verilog 不用内部时钟 LED 控制

摘要: module led( clk_40mhz, rst_n, led_1, spi_cs_n, spi_clk, spi_mosi, spi_miso, gpio_95, gpio_94, gpio_93 ); input clk_40mhz; // pin62 input rst_n; // pin 阅读全文

posted @ 2025-08-03 17:18 所长 阅读(15) 评论(0) 推荐(0)

2025年8月2日

verilog 代码并行 波形验证

摘要: SPI_CLK , 每来一个时钟, 值进行 -1, 上代码 和 波形: always @(posedge spi_clk or negedge rst_n) begin if(!rst_n) begin rx_cnt <= 8'd7; end else if((!spi_cs_n)&&(rx_cnt 阅读全文

posted @ 2025-08-02 22:27 所长 阅读(15) 评论(0) 推荐(0)

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