摘要：转载于: http://blog.csdn.net/mmhh3000/article/details/7677490 P12 钽电容在不同频率下容量表现非常稳定；陶瓷电容不足够稳定；铝电解很不稳定； P13 在大范围频段内： 陶瓷电容的ESR表现得出奇地低(100k时最低0.002欧)，但随频率变动
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文章分类 - PCB
摘要：在国内提到硬件开发，华为无疑是最优秀的公司。所以，硬件创业者从华为出来的也非常多。这篇文章非常详细的介绍了华为硬件开发的流程，非常值得其他硬件开发者借鉴。 很多朋友咨询一些硬件问题，发现朋友们没有仔细的看datasheet，也没有好好的做电路分析。我讲一讲华为是怎么做硬件开发的，给正在做硬件开发的朋
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摘要：转载于:http://blog.csdn.net/wu20093346/article/details/37834771 电源和地层大块平面间构成了谐振腔，高速数字信号经过时，犹如快艇在湖面掀起一阵波浪，电源地之间电压起了波动。既然是谐振（机械上叫共振），就要固有频率，这个固有频率是与电源和地平面的
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摘要：转载于: http://www.mr-wu.cn/cadence-allegro-ru-he-bi-mian-guo-kong-via-guo-yu-kao-jin-han-pan-zao-cheng-dfm-wen-ti/ 如果过孔via过于靠近焊盘，或者直接在焊盘上打过孔，在SMT时，就会漏锡造
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摘要：转载于:http://www.mr-wu.cn/pcb-dian-lu-ban-zhou-wei-na-yi-quan-guo-kong-huo-jin-shu-hua-bao-bian-shi-zuo-sha-yong-de/ 老wu经常看到很多工控板或者射频板在PCB板的四周会打上一圈的过孔和铜
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摘要：http://blog.csdn.net/u014073301/article/details/74518795 在PCB设计中，过孔VIA和焊盘PAD都可以实现相似的功能。它们都能插入元件管脚，特别是对于直插(DIP)封装的的器件来说，几乎是一样的。 但是！在PCB制造中，它们的处理方法是不一样的
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摘要：转载于:http://blog.csdn.net/wu20093346/article/details/38050917 通过以上步骤对每个平面进行了单节点分析并观测了响应曲线，接下来将观测平面对的目标阻抗是否满足要求，通过选择电容器的方法来减小含有电容器阻抗响应曲线中的反谐振波峰。在SigWave
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摘要：转载于: http://blog.csdn.net/wu20093346/article/details/38025197 软件版本：Cadence 16.5 使用工具：Allegro PCB PI Option XL Power Integrity 使用资源：仿真实例下载地址：http://dow
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摘要：转载于:http://blog.sina.com.cn/s/blog_1538bc9470102w482.html PCB中导入网表后，设置层叠结构（电源层、地层），划分好电源层，接下来： a) 将allegro切换到Allegro PCB PI option XL版本，Analysis->Pref
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摘要：转载于:http://blog.csdn.net/wu20093346/article/details/38658277 在电源完整性设计一文中，推荐了一种基于目标阻抗（target impedance）的去耦电容设计方法。在这种方法中，从频域的角度说明了电容选择方法。把瞬态电流看成阶跃信号，因而有
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摘要：DRC错误代码 代码 相关对象 说明 单一字符代码 L Line 走线 P Pin 元件脚 V Via 贯穿孔 K Keep in/out 允许区域/禁止区域 C Component 元件层级 E Electrical Constraint 电气约束 J T-Junction 呈现T形的走线 I I
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摘要：转载于:https://zhidao.baidu.com/question/811428515891146412.html导出网络表时，报出错误： #1 ERROR(305) Device/Symbol check error detected.Symbol 'LED3' for device 'L
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摘要：利用Cadence Allegro强大的功能节省您调丝印的时间 http://www.mr-wu.cn/li-yong-cadence-allegro-qiang-da-de-gong-neng-jie-sheng-nin-tiao-si-yin-de-shi-jian/
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摘要：转载于: http://blog.sina.com.cn/s/blog_6e350d880101e3yz.html 虽然现在PCB制造的工艺8mil已经不是什么问题，但我还是保险一直使用10mil。但是在放置FootPrint LQFP100的时候，我引脚的Width属性是11mil，由于靠得过于接
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摘要：转载于: http://blog.sina.com.cn/s/blog_6b6832cc0102wfc5.html 一、1.0mm BGA (1)过孔间过一根线:使用10-22的孔，线宽6mil，线到孔盘5.5 mil (2)过孔间过一根线:使用8-18的孔，线宽6mil，线到孔盘7.5mli (3
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摘要：转载于 :http://blog.csdn.net/lujingze/article/details/54387832 画PCB画的多了，村民们不可避免会遇到这种问题，就是有一些固定布局的PCB模块会经常用到，比如FPGA或者单片机的最小系统等，这些布局在不同的PCB中是可以完全一致的。这样，如果每
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摘要：转载于: http://www.eefocus.com/szbluefly/blog/17-04/417717_8e63e.html 为了更快的传输数据，我们能想到的办法除了一次多传输几位数据（增加并行总线的数量）之外，还有一种办法就是提高单通道的数据传输速率，然而随着单通道速率的提升，信号完整性问
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摘要：转载于: http://blog.csdn.net/times_poem/article/details/51839823 需求说明：Cadence基本知识 内容 ：第一部分 PCB设计之3W原则 第二部分 PCB设计之3W原则与20H原则图示 第三部分 3W原则的实质详解 来自 ：时间的诗 第一部
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摘要：转载于: http://www.pcbbar.com/forum.php?mod=viewthread&tid=4181&highlight=flash FLASH(闪速存储器)引脚图 布局:一般采用菊花链拓扑结构 布线： 信号线需要控制阻抗，特性阻抗:50欧 线与线中心间距满足3W原则 等长控制误
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摘要：转载于: https://www.cnblogs.com/lianjiehere/p/4757070.html 第二章时域与频域 带宽与上升时间的关系 意味着带宽越宽上升时间就越短，波形就越接近方波。这里的带宽是有效带宽，跟我们平常所说的带宽不一样，关于什么是”有效的“，作者专门做了说明。 最后一段
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