摘要：PCB板的标准厚度有：0.70mm, 0.80mm、0.95mm、1.00mm、1.27mm、1.50mm、1.60mm、2.00mm、2.40mm、3.00mm, 3.20mm、3.50mm、4.00mm、6.40mm等。 1、其中以最多见的1.6mm嘉立创的PCB为例： 由最上面的四层板层压图可
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摘要：https://baijiahao.baidu.com/s?id=1615378279830021741&wfr=spider&for=pc 今天来讲一讲PCB叠层文件， 我们都知道，电路板的叠层安排是对PCB的整个系统设计的基础。叠层设计如有缺陷，将最终影响到整机的emc性能。那么下面就和咱一起来
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摘要：在PCB设计中为了减少线间串扰，应保证线间距足够大，当线中心间距不少于3倍线宽时，则可保持大部分电场不互相干扰，这就是3W规则。如下图所示。 满足3W原则能使信号间的串扰减少70%，而满足10W则能使信号间的串扰减少近98%. 3W原则虽然易记，但要强调一点，这个原则成立是有先前条件的。从串扰成因的
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摘要：一直在论坛上问各位做封装和画板时对0.65mm间距的bga怎么处理。今天在TI网上看到篇文章， 受益匪浅，推荐各位也读一读： Flip Chip Ball Grid Array Package Reference Guide （SPRU811A） 链接不记得，搜索上面那些就有。 说一些心得： 阻焊，
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摘要：原文：https://blog.csdn.net/shishu8385/article/details/85615399 2019年元旦，依然在家里苦逼加班，当天被 0.65mm间距的BGA扇出，弄的心烦意乱，连续的加班，弄的差点崩溃，直到和老婆出去逛了逛，才感觉好了点，不料手还在逛店的时候被划伤了
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摘要：30. 在仿真结果区域上边的下拉列表中，选择All Observation and VRM Ports，显示所有观测点位置的阻抗。(没有修改的话，默认显示的是第一个观测点的阻抗) 31. 在左边的电容方案列表中，用鼠标或者键盘的方向键，浏览不同的电容方案，在右边的窗口观察相应的综合性能、电容成本、阻
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摘要：本模块中，我们将会用OptimizePI分析不同的电容滤波方案对几个IC器件的电源阻抗的影响，从OptimizePI推荐的方案中选择合适的方案优化PDN设计。 15. 在Workflow中选择“Discretes(Optional)”，这一步用于检查和设置如电感、磁珠、电阻等其它器件的模型。本案例中
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摘要：本模块中，我们将会用OptimizePI分析不同的电容滤波方案对几个IC器件的电源阻抗的影响，从OptimizePI推荐的方案中选择合适的方案优化PDN设计。 9. 在Workflow中选择“Define VRM Models”，添加VRM的模型，类型选择Resistor，阻值按默认的10 mohm
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摘要：本文大纲 1. 去耦电容仿真设置（一） 2. 去耦电容仿真设置（二） 3. 去耦电容仿真设置（三） 4.仿真优化结果查看 关于OptimizePI 去耦电容的优化需要综合考虑PDN的性能和成本因素，在目前的PCB或封装设计中，往往存在PDN电源噪声(包括低频和高频)超标、性能不满足设计、成本较高等问
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摘要：https://blog.csdn.net/wu20093346/article/details/38025197 软件版本：Cadence 16.5 使用工具：Allegro PCB PI Option XL Power Integrity 使用资源：仿真实例下载地址：http://downloa
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摘要：1、什么时FANOUT布线？FANOUT布线：延伸焊盘式布线。为了保证SMD器件的贴装质量，一般遵循在SMD焊盘上不打孔的原则，因此用fanout布线，从SMD器件的焊盘向外延伸一小段布线，再放置VIA，起到在焊盘上打孔的作用。在LAYOUT PLUS 中，用AUTO/Fanout/Board，实现
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摘要：http://www.eda365.com/thread-146924-1-1.html PCB LAYOUT工程师最怕自己犯的错误是PCB制板回来发现有开路和短路且板子只能报废.制板的费用比设计的费用还要高,我想没有一个LAYOUT工程师不自责的.想要不犯错必须有足够的经验和细心.一个不细心可能会
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摘要：1. 鼠标设定: 在ALLEGRO视窗LAYOUT时,每执行一个指令例：Addconnect, Show element等鼠标会跳到Option窗口,这样对layout造成不便.1) 控制面版＞滑鼠之移动选项中,指到预设按钮（或智慧型移动）：取消“在对话方块将滑鼠指标移到预设按钮”设置2. Text
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摘要：1. 鼠标设定: 在ALLEGRO视窗 LAYOUT时,每执行一个指令例：Add connect, Show element等鼠标会跳到Option窗口,这样对layout造成不便.1) 控制面版＞滑鼠之移动选项中,指到预设按钮（或智慧型移动）：取消“在对话方块将滑鼠指标移到预设按钮”设置2. Te
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摘要：转载于：http://www.mr-wu.cn/li-yong-cadence-allegro-qiang-da-de-gong-neng-jie-sheng-nin-tiao-si-yin-de-shi-jian/ 调丝印、拉等长、撩妹是老wu的工作日常，? 现在，随着Cadence Allegr
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摘要：转载：https://blog.csdn.net/edadoc2013/article/details/73321254 我们先用Saturn的工具来算一下过孔的载流，还是采用IPC2152修正后的规范。需要下载Saturn的工具的，可以前往http://www.edadoc.com/cn/Tech
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摘要：https://www.altium.com.cn/blog/%E8%A7%84%E5%88%99%E8%AE%BE%E7%BD%AE%E5%A6%82%E4%BD%95%E5%BA%94%E7%94%A8%E4%BA%8E%E6%88%91%E7%9A%84pcb%E8%AE%BE%E8%AE%A
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摘要：使用Allegro进行PCB设计时，有时需要更改丝印的大小及粗细，进行这些操作的具体方法如下。更改字体的大小菜单栏选择Edit-->Change，右侧弹出Options选项，选择Class : New subclass = Ref Des : Silkscreen_Top，设置Text block，
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摘要：https://blog.csdn.net/LIYUANNIAN/article/details/83154178 简单地说，先从PCB板厂拿到想要的参数后，输入不同的线宽，试出50Ω阻抗，此时的线宽就是我们需要的。 以下是一个八层板的例子。 在Allegro中点击Setup -> Cross-se
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摘要：https://blog.csdn.net/LIYUANNIAN/article/details/83188464?utm_source=blogxgwz6 简单地说，从PCB板厂拿到各层的Thickness参数（或许介电常数也可以提供）后，利用Si9000设定好差分阻抗100Ω，计算出合适的差分线
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