随笔分类 - 课程--计算机组成原理
摘要:
from pixiv CPU CPU的命名规则 Intel 13 15 17 19这些是同一时间发布,即是想要说明i5不一定比i7性能要低 2023年的i5比2018年的i7肯定好很多 我们更应该关注的是代数: 以下分别为8代i7,4代i7,1代i7 子型号 尾缀 无尾缀 U K F KF 如果买了
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from pixiv CPU CPU的命名规则 Intel 13 15 17 19这些是同一时间发布,即是想要说明i5不一定比i7性能要低 2023年的i5比2018年的i7肯定好很多 我们更应该关注的是代数: 以下分别为8代i7,4代i7,1代i7 子型号 尾缀 无尾缀 U K F KF 如果买了
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摘要:
Cache 存储体系功能操作的实现 物理地址 Cache 地址变换 这里首先要说明的是:主要是记住各个映像规则关系和变化方法 同时根据映像规则需要能够写出 主存地址,Cache地址,映像表的格式 《全相联》 从图中我们可以看出相联度为Cb 所谓相联度即是主存储器中的任意一块可以映射到Cache存储器
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Cache 存储体系功能操作的实现 物理地址 Cache 地址变换 这里首先要说明的是:主要是记住各个映像规则关系和变化方法 同时根据映像规则需要能够写出 主存地址,Cache地址,映像表的格式 《全相联》 从图中我们可以看出相联度为Cb 所谓相联度即是主存储器中的任意一块可以映射到Cache存储器
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摘要:
《编码》 信息源熵是一种上限,一般来说是不可能达到的 其用来当作是一种标准 《Huffman》 这点告诉我们,在二进制数编码的情况下,Huffman编码是最优的,即平均码长可以达到最短 《长度固定编码法 》 《扩展编码法》 这里的1-2-3-5 是指出扩展之后指令各个的可能码长 《延迟转移与指令取消
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《编码》 信息源熵是一种上限,一般来说是不可能达到的 其用来当作是一种标准 《Huffman》 这点告诉我们,在二进制数编码的情况下,Huffman编码是最优的,即平均码长可以达到最短 《长度固定编码法 》 《扩展编码法》 这里的1-2-3-5 是指出扩展之后指令各个的可能码长 《延迟转移与指令取消
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摘要:
恢复内容开始 流水线的基本概念 流水线的分类 流水线的评判标准 吞吐量 加速比 效率 计算效率其实就是计算流水线时空图中的面积 分子的面积是 实际用到的面积 分母的面积是 功能段数*总时间 题目分析: 注意他这个画时空图的方法,十分清楚明白 流水线的瓶颈段以及解决方法 什么是流水线的瓶颈段? 如下图
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恢复内容开始 流水线的基本概念 流水线的分类 流水线的评判标准 吞吐量 加速比 效率 计算效率其实就是计算流水线时空图中的面积 分子的面积是 实际用到的面积 分母的面积是 功能段数*总时间 题目分析: 注意他这个画时空图的方法,十分清楚明白 流水线的瓶颈段以及解决方法 什么是流水线的瓶颈段? 如下图
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摘要:
练习心得 在汇编中 X DB 12H 和 X EQU 12H 的区别? X DB 12H:这表示将一个字节数据12H存储到变量X中。DB是"Define Byte"的缩写,用于定义一个字节长度的数据项。因此,X DB 12H可以看作是将一个字节大小的空间分配给变量X,并将值12H存储到这个空间中。
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练习心得 在汇编中 X DB 12H 和 X EQU 12H 的区别? X DB 12H:这表示将一个字节数据12H存储到变量X中。DB是"Define Byte"的缩写,用于定义一个字节长度的数据项。因此,X DB 12H可以看作是将一个字节大小的空间分配给变量X,并将值12H存储到这个空间中。
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摘要:
《8086寻址方式》 寻址主要可以分为3类: 数据寻址 程序转移地址寻址(即查找下一条指令的地址) 端口寻址 解释一下端口: 端口也要编址,其编址方式有两种: 1.集中编址 即端口在内存中,占内存的空间进行编址 2.独立编址 端口独立与内存之外 这样有个好处是内存的空间更大了 但是在寻址的时候为了区
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《8086寻址方式》 寻址主要可以分为3类: 数据寻址 程序转移地址寻址(即查找下一条指令的地址) 端口寻址 解释一下端口: 端口也要编址,其编址方式有两种: 1.集中编址 即端口在内存中,占内存的空间进行编址 2.独立编址 端口独立与内存之外 这样有个好处是内存的空间更大了 但是在寻址的时候为了区
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摘要:1.什么是计算机体系结构 “计算机体系结构”是由 G.M.Amdahl 等人于 1964 年提出的,当时意指程序员看到的计算机属性, 即程序员为编写出可以在计算机上正确运行的程序所必须掌握的计算机功能特性与概念结构。 影响计算机(硬件)性能的根本因素 1. 器件更新是计算机(硬件)换代的基本标志 2
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摘要:
《Intel 8086CPU的内部结构》 通用寄存器AX,BX,CX,DX AX:累加器 BX:基址寄存器 CX:计数寄存器 DX:数据寄存器 具体师大书P12 专用寄存器BP,SP,DI,SI BP:基址寄存器 SP:堆栈指针寄存器 DI:目的变址寄存器 SI: 源变址寄存器 段寄存器CS,DS,
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《Intel 8086CPU的内部结构》 通用寄存器AX,BX,CX,DX AX:累加器 BX:基址寄存器 CX:计数寄存器 DX:数据寄存器 具体师大书P12 专用寄存器BP,SP,DI,SI BP:基址寄存器 SP:堆栈指针寄存器 DI:目的变址寄存器 SI: 源变址寄存器 段寄存器CS,DS,
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这个说明操作数地址有多个,正是下面我们的四地址码,三地址码等的内容 操作码: 解释: 如何理解? 即三地址指令操作码每保留一个码点用作扩展, 后二地址就可以用其4位的地址码进行编码即有2^4(在地址码长度为4的情况下) 看如下题目来理解一下: 如果有N条二地址指令,每个地址码为6位,则操作码长度为1
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这个说明操作数地址有多个,正是下面我们的四地址码,三地址码等的内容 操作码: 解释: 如何理解? 即三地址指令操作码每保留一个码点用作扩展, 后二地址就可以用其4位的地址码进行编码即有2^4(在地址码长度为4的情况下) 看如下题目来理解一下: 如果有N条二地址指令,每个地址码为6位,则操作码长度为1
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摘要:
写题记录: 解: 我们知道32位为单精度浮点数,其阶码部分有8位(含阶符) 其尾数部分有24位(含数符,即把符号位也包含进去了) 即真正用来记录数据的部分是23位 由于尾数是原码,规格化后的原码不管是正还是负 都是0.1xxxx 或 1.1xxxx 的形态,所以我们省去1,默认尾数开始就有数2^0=
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写题记录: 解: 我们知道32位为单精度浮点数,其阶码部分有8位(含阶符) 其尾数部分有24位(含数符,即把符号位也包含进去了) 即真正用来记录数据的部分是23位 由于尾数是原码,规格化后的原码不管是正还是负 都是0.1xxxx 或 1.1xxxx 的形态,所以我们省去1,默认尾数开始就有数2^0=
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摘要:
写在前面: 由于存储器这一章知识十分繁多,笔记本写不下了 在这里记录: 1.半导体存储器芯片的一般结构 2.MOS写常态存储器芯片 3.主存储器以及其容量,带宽扩展组织 的详细内容 主要参考资料是哈工大刘老师的视频 与本校江师大的计算机组成原理教材 半导体存储器芯片: 我们知道: 半导体存储器可以适
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写在前面: 由于存储器这一章知识十分繁多,笔记本写不下了 在这里记录: 1.半导体存储器芯片的一般结构 2.MOS写常态存储器芯片 3.主存储器以及其容量,带宽扩展组织 的详细内容 主要参考资料是哈工大刘老师的视频 与本校江师大的计算机组成原理教材 半导体存储器芯片: 我们知道: 半导体存储器可以适
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摘要:《概述》 《基本概念》 即我们只要事先在计算机内部,设置与总线相连的多个接口,当要添加外设时,只要将外设与相应接口相连,即可解决 I/O设备与主机之间连接的灵活性问题 《总线的分类》 《按照数据传输格式来分类》 《按照总线的功能来分类》 《重要的系统总线》 《系统总线结构》 单总线结构无论是块的设备
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摘要:首先对于我们所熟知的奇偶校验,对于偶校验来说: 我们往最前面添加一个校验位,但是一个校验位只能表示两种状态,即对或错 现在我们希望能够知道更多的信息,即要增加校验位的个数 我们可以将信息位进行分组,比如要分成k组,每一组中都要有一个校验码; 则我们就有了校验码:P1,P2,P3.....Pk。 对比
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摘要:
指令: 操作码字段: 操作数类型: 即指令要处理的数据的类型 这些数据在存储器中的存储方式为何?可以到存储器那章去复习 操作类型: 1.数据传送 2.算数逻辑操作 3.移位操作 4.转移 5.调用和返回 6.陷阱(中断) 7.输入输出 寻址方式: 思考为何要这么多的寻址方式? 指令寻址: 指令只保存
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指令: 操作码字段: 操作数类型: 即指令要处理的数据的类型 这些数据在存储器中的存储方式为何?可以到存储器那章去复习 操作类型: 1.数据传送 2.算数逻辑操作 3.移位操作 4.转移 5.调用和返回 6.陷阱(中断) 7.输入输出 寻址方式: 思考为何要这么多的寻址方式? 指令寻址: 指令只保存
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