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Verilog 轻量化开发环境 背景 笔者常用的开发环境 VIAVDO, 体积巨大，自带编辑器除了linting 能用，编辑器几乎不能用，仿真界面很友好，但是速度比较慢。 Sublime Text, 非常好用的编辑器，各种插件使用verilog 非常方便，可以自动补全、生成调用、linting等； 阅读全文
posted @ 2024-09-11 22:36
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原因 当Windows操作系统遇到严重错误导致系统崩溃时，屏幕显示为蓝色，通常伴有错误代码和信息，这被称为“蓝屏死机”（Blue Screen of Death，简称BSOD） https://www.thepaper.cn/newsDetail_forward_28126297 这次蓝屏事件影响非 阅读全文
posted @ 2024-07-23 10:00
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Hello-FPGA info@hello-fpga.com S710系列相机配置 目录 S710系列相机配置 4 1 S710相机说明 4 2 配置说明 5 2.1 BANK说明 5 2.2 BANK 配置 6 2.3 像素重新排列 6 2.4 配置示例 BANK A 4ports 7 图 1‑1 阅读全文
posted @ 2024-03-19 16:03
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Hello-FPGA CoaXPress 2.0 Device FPGA IP Core Demo 1 说明 本手册针对Helllo-FPGA的CoaXPress 2.0 DEVICE FPGA IP Core demo工程，用于演示IP的使用方法、配置流程。本文的内容适用于所有开发板。 Demo 阅读全文
posted @ 2024-02-28 15:08
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Hello-FPGA ZYNQ 设计开源啦！ 开源ZYNQ核心板 + 底板 硬件设计、软件设计，软件设计使用裸机演示，演示了如何使用AXI DMA等关键dma 模块 欢迎加QQ 讨论 947559581 https://github.com/Hello-FPGA 核心板结构 硬件实物 阅读全文
posted @ 2023-11-08 09:02
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Hello-FPGA CoaXPress 2.0 FMC Card User Manual 4 1 CoaXPress 简介 4 2 CoaXPress 4R FMC 5 2.1 硬件特性 5 2.2 框图说明 7 2.3 电源监测 8 3 CoaXPress 4T FMC 9 3.1 硬件特性 9 阅读全文
posted @ 2023-09-27 10:36
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目录 Hello-FPGA CoaXPress 2.0 Host FPGA IP Core Demo 4 1 说明 4 2 设备连接 5 3 VIVADO FPGA工程 6 4 SDK工程 9 图 1‑1 VIVADO工程目录结构 4 图 1‑2 SDK工程目录结构 4 图 2‑1 ZCU102结构 阅读全文
posted @ 2023-07-07 16:50
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## 什么是downlink数据 downlink指的是相机传输到host采集卡的高速链路，其中包含了如下类型的数据： 1、Stream Data 2、Trigger Ack, Trigger； 3、Ack (reply data)； 4、Event, Heartbeat 
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摘要：
## 什么是GTH GTH 是Xilinx UltraScale系列FPGA上高速收发器的一种类型，本质上和其它名称如GTP, GTX等只是器件类型不同、速率有差异；GTH 最低速率在500Mbps，最高在16Gbps 
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CoaXPress CRC 在CXP协议中，CRC用在stream packet和control packet中，用于指示数据是否错误，如果是control packet， device发现CRC错误后应该给出CRC错误的回应。 下表是回应的packet格式，在高速数据链路downconnectio 阅读全文
posted @ 2023-05-23 09:59
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AD7793简介 https://www.analog.com/media/en/technical-documentation/data-sheets/AD7792_7793.pdf 特点如下，有16bit和24bit 2个版本可选，使用4线制SPI接口： 控制ADC 现在要用xilinx FPG 阅读全文
posted @ 2023-02-07 16:50
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设备说明 PCIe-CLS2000是基于PCIe 接口的2通道 camera link base接口图像模拟源，适用于图像数据源模拟、接收处理平台测试等场景。 PCIe Gen2x4/x8 接口，支持3GB/s吞吐率； 板载2GB 缓存； 2 通道标准cameralink base通路，可以独立工作 阅读全文
posted @ 2022-11-02 09:55
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DMA是direct memory access，在FPGA系统中，常用的几种DMA需求： 1、 在PL内部无PS（CPU这里统一称为PS）持续干预搬移数据，常见的接口形态为AXIS与AXI，AXI与AXI； 2、 从PL与PS之间搬移数据，对于ZYNQ就比较好理解，属于单个芯片内部接口，对于PCI 阅读全文
posted @ 2022-06-17 16:09
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CoaXPress 背景 CoaXPress (简称CXP)是指一种采用同轴线缆进行互联的相机数据传输标准，主要用于替代之前的cameralink协议，常见于科学相机、工业相机、医学图像、航空防务等场景。之前这些场景都是使用cameralink接口的相机，cameralink 由于线缆的形式、传输速 阅读全文
posted @ 2022-05-23 18:40
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摘要： 
1 PCI IP设计 虽然PCI已经逐渐淘汰，但是还是有不少应用需要这样的接口通讯。 设计目的是为了提供基于源码的PCI IP，这样硬件就不必受限于某一个FPGA型号，也方便ASIC迁移。由于PCI的电气标准都是标准3.3V电平，不像PCIe需要高速收发器、8b/10b编码等技术的支持，因此设计一个 阅读全文
1 PCI IP设计 虽然PCI已经逐渐淘汰，但是还是有不少应用需要这样的接口通讯。 设计目的是为了提供基于源码的PCI IP，这样硬件就不必受限于某一个FPGA型号，也方便ASIC迁移。由于PCI的电气标准都是标准3.3V电平，不像PCIe需要高速收发器、8b/10b编码等技术的支持，因此设计一个 阅读全文
posted @ 2022-02-16 09:55
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1 涉及术语解释 1.1 三模冗余 三模冗余系统简称TMR(Triple Modular Redundancy)，是最常用的一种容错设计技术．三个模块同时执行相同的操作，以多数相同的输出作为表决系统的正确输出，通常称为三取二．三个模块中只要不同时出现两个相同的错误，就能掩蔽掉故障模块的错误，保证系统 阅读全文
posted @ 2022-02-15 22:52
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摘要：
PXIe简介 PCI eXtensions for Instrumentation or PXI is a computer-based hardware and software platform for test and measurement systems. Developed in the 阅读全文
posted @ 2022-02-15 22:17
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DFX 动态重构的概念和实现 背景介绍 本文内容当前仅限于XILINX或者和XILINX具有相同结构的FPGA器件。 FPGA 技术提供了在现场进行编程和重新编程的灵活性，而无需通过重新制造流程来实现设计修改。动态功能交换（Dynamic Function eXchange, DFX）将这种灵活性提 阅读全文
posted @ 2025-06-22 10:10
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XILINX FPGA局部重构的一些关键概念和方法-bitstream Bitstream 类型定义 (ug909) 在进行局部重构设计时，bitstream 分为如下类型： • Full Configuration Bitstreams • Partial Bitstreams • Blankin 阅读全文
posted @ 2025-06-05 13:16
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✅ Xilinx（AMD）7 系列 FPGA 的配置机制 🧩 核心概念 FPGA 是“空白”硬件，必须通过加载bitstream（比特流）文件来定义其功能。 Bitstream 是一个二进制文件，包含所有逻辑、互连和 I/O 的配置信息。 配置数据存储在 CMOS 配置锁存器（CCL）中，属于 S 阅读全文
posted @ 2025-06-05 09:28
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背景 在CoaXPress Over Fiber的需求中, 需要利用XGMII的PCS 实现25G 数据速率的稳定传输，也就是不需要其MAC层，只保留PMA PCS层，借用其物理端口 线缆，实现其它协议的数据传输。 25G PCS 25GMII 的 TX/RX 时钟频率在 DDR（双倍数据速率）模式 阅读全文
posted @ 2025-05-25 20:51
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背景 笔者是嵌入式工程师，主要在FPGA平台工作，偶尔会需要编写一些上位机的通讯、控制代码，之前一直使用C#，最近接触了QT，讲一下使用体验吧。 这是QT 编写的一个设备管理、显示业务界面，主要是对设备进行在线更新、显示使用。 嵌入式工程师在编写底层和设备通讯代码的时候 都习惯用C，我也不例外，那么 阅读全文
posted @ 2025-04-17 14:12
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https://www.cnblogs.com/xingce/p/18767054 25G 光纤 板子有2个SFP+的光纤接口，最大支持25G速率，使用ibert 进行验证，SFP在BANK227的GTY 接口。 ibert 配置如下： 测试 测试符合预期，确认了SFP的具体位置 和 支持的速率，为 阅读全文
posted @ 2025-04-15 20:36
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摘要：
Hello-FPGA info@hello-fpga.cOM 8xCXP相机采集系统介绍 目录 1 系统概述 4 2 硬件架构 5 2.1 FPGA处理单元 5 2.2 CXP接口层 6 2.3 CXP相机说明与使用要求 7 2.4 SSI控制器板 8 3 FPGA方案 9 3.1 FPGA实现 9 阅读全文
posted @ 2025-03-24 18:04
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摘要：
Hello-FPGA info@hello-fpga.cOM 串口通信接口标准 RS232、RS422、R485 目录 串口通信接口标准 4 1 RS232 4 1.1 引言 4 1.2 协议原理 4 1.3 电平标准 5 1.4 应用场景 5 1.5 优缺点 6 1.5.1 优点 6 1.5.2 阅读全文
posted @ 2025-03-24 17:47
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摘要：
在Xilinx FPGA设计中，IOB=FORCE是一个与输入输出块（IOB）相关的属性设置。这个设置主要用于控制逻辑是否被推入到IOB（Input/Output Block）中，即FPGA芯片边缘的I/O引脚附近的专用硬件资源。使用IOB属性可以帮助优化信号路径，减少延迟，特别是在对时序要求严格的 阅读全文
posted @ 2025-03-20 15:13
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背景 淘了一个好玩的阿里FPGA加速卡，PCIe Gen3x8, SFP *2 最大25G，官方用来加速网络应用的，我拿到主要想用SFP 功能，来做一下CXP OVER FIVER 10G/25G的验证工作 实验 连接JTAG，板子丝印有JTAG 线序名称，根据线序 连接即可，正常连接后就能看到FP 阅读全文
posted @ 2025-03-12 11:20
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浙公网安备 33010602011771号