随笔分类 - ARM
摘要：ASNI 介绍 CoreLink NI-700的ASNI（ AXI系统网络接口 ）完成者单元负责接收并处理来自 AXI 请求者设备的请求。这些单元将事务打包成根据NI-700通用传输（GT）协议的Flits，并将GT响应Flits解包成AXI响应。ASNI执行以下功能： AXI与GT协议之间的请求、
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摘要：NI-700 Interconnect CoreLink NI-700是 ARM 推出的一款高度可配置的、符合AMBA标准的系统级互连产品。通过NI-700，可以创建一个非一致性互连，该互连针对SoC设计的功耗、性能和面积（PPA）要求进行了优化。NI-700设计用于扩展，适用于大型设计作为背板互连
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摘要：1.1 ARM NIC-400(Network interconnect) CoreLink NIC-400（Network Inter Connect）网络互连是高度可配置的，能够创建一个完整的高性能、优化和符合AMBA标准的网络基础设施。CoreLink NIC—400网络互连有许多配置。它们的
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摘要：CCI-400 和 CCI-500 差异 ARM 的 CCI（Cache Coherent Interconnect）系列产品是用于多核处理器之间的高性能缓存一致性互连。CCI-400 和 CCI-500 是该系列中的两种设计，它们旨在允许多个处理器核心和其他资源（如GPU、DMA控制器等）有效地共
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摘要：1.1 CCI-500 介绍 CCI-500 是个可编程高带宽的互联，可以通过硬件来保证 缓存一致性 ，使用硬件来保证缓存一致性可以有效提高系统性能和减少功耗，主要优点有以下几点： 减少对外部memory的访问； 降低软件开销和复杂性； 保驾 ARM big.LITTLE 架构的正常工作。 CCI-
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摘要：这篇是ARM电源管理系列文章中的一篇。 今天来看SCMI（System Control and Management Interface）。SCMI是用于系统管理的一组独立于操作系统的软件接口，包括以下几个方面： 电源域管理 性能管理 时钟管理 传感器管理 复位管理 电压域管理 这里提一句，电源域管
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摘要：特性介绍 MPAM 是 ARM v8.4引入的Cache QoS和 内存带宽QoS功能特性，是目前业界与之最接近的是 intel 的 RDT 特性。引入MPAM功能特性，主要是为了解决CPU访存过程中因为共享资源的竞争带来的关键性业务性能下降或者系统整体性能下降的问题，这对于混部业务的部署来说，尤为
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摘要：该框架旨在提供标准内核接口来控制 SoC 上的互连设置。这些设置可以是多个互连设备或功能块之间的吞吐量、延迟和优先级。这可以动态控制以节省功率或提供最大性能。 互连总线是具有可配置参数的硬件，可以根据从各种驱动程序接收到的请求在数据路径上设置这些参数。互连总线的一个例子是芯片组中各种组件或功能块之间
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摘要：ARM Cortex-M 32-bit 年份 核心 2004年 Cortex-M3 2007年 Cortex-M1 2009年 Cortex-M0 2010年 Cortex-M4 2012年 Cortex-M0+ 2014年 Cortex-M7 2016年 Cortex-M23 2016年 Cort
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摘要：CCI Family CCI-550 简介 Arm CoreLink CCI-550 Cache Coherent Interconnect 扩展了 CoreLink CCI-500。它在 big.LITTLE 处理器集群之间提供完整的缓存一致性，并为其他代理（如 Mali GPU、网络接口或加速器
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摘要：NOC（Network on Chip）和NIC（Network Interface Controller）都有非常明确的应用场景和作用，但它们工作在不同的层次，并解决不同的问题。 NOC（Network on Chip） 作用和功能: NOC设计用于解决片上系统（SoC）内部不同组件之间的通信需求
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摘要：CCI-400 介绍 CCI（Cache Coherent Interconnect）是ARM中的cache一致性控制器。 CCI-400将互连和一致性功能结合到一个模块中。它支持多达两个ACE 主节点的连接，例如： Cortex®-A7 processor Cortex-A15 processor
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摘要：ARM CoreLink 介绍 ARM的CoreLink系列产品是一套能够进行高效互联的组件和工具，它们用于构建高性能、低功耗的嵌入式和消费电子设备。CoreLink产品系列提供了用于多处理器系统的一组互连性能，这些功能包括各种总线架构，以及与之配套的内存和外设接口。 CoreLink系列的组件包括
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摘要：一，同步异常的分析 在文章ARMv8-AArch64 的异常处理模型详解之异常类型 Exception types中提到过，同步异常是处理器在执行指令时产生的异常，是一种精确的，可以具体定位到是哪条指令导致异常的产生。下面笔者将介绍三个用于定位并分析同步异常产生的寄存器。 1.1 同步异常分析-异常
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摘要：概述 在 摩尔定律 的推动下，集成电路工艺取得了高速发展，单位面积上的晶体管数量不断增加。片上系统（System-on-Chip，SoC）具有集成度高、功耗低、成本低等优势，已经成为大规模集成电路系统设计的主流方向，解决了通信、图像、计算、消费电子等领域的众多挑战性的难题。随着片上系统SoC的应用需
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摘要：ARM的ACE（AXI Coherency Extensions）和ACE-Lite是ARM的AXI（Advanced eXtensible Interface）总线协议的扩展版本，用于实现多核处理器系统中的缓存一致性。 ARM提供了ACP和ACE-lite接口，这两个接口都有device cohe
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摘要：ARM CoreLink 是 ARM 公司开发的一系列系统 IP（知识产权）产品，用于连接和管理片上系统（SoC）中的各个组件。它是 ARM 系统设计生态系统的重要组成部分，旨在帮助芯片设计者更快速、更高效地开发复杂的 SoC 设计。让我为您详细介绍一下 ARM CoreLink： 主要功能： 互连
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摘要：如果将block的内存属性配置成Non-cacheable，那么数据就不会被缓存到cache，那么所有observer看到的内存是一致的，也就说此时也相当于Outer Shareable。 其实官方文档，也有这一句的描述： 在B2.7.2章节 “Data accesses to memory loc
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摘要：1. 从ARM32到ARM64 从ARM32到ARM64不止将处理器从32位升级到了64位，还有许多性能的技术也得到了极大的提升，光是个头长了可不行啊！能耐也得跟着长啊！哈哈哈 1.1 ARM32的TLB机制 如上图所示，上一讲我们讲了TLB的每一条表项都有一个bit用来表示自己是全局的（内核空间）
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摘要：本文主要介绍 Armv8/v9 指令集架构中常用部分，详细的还是要看 Arm architecture reference manual. ARMv8 架构 ARMv8 架构支持3种指令集: T32, A32, A64 ARMv8 架构有两种执行状态: AArch32, AArch64 一个App
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