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Pro Git Scott Chacon 序 欢迎来到 Pro Git 第二版。 第一版出版到现在已经过去了四年。 到今天，Git 虽然出现了许多改变，但是还有很多重要的事情一如昨日。 因为 Git 核心团队对保持向后兼容性异常固执，所以直到今天大多数核心命令与概念依然有效，但是围绕 Git 的社区 阅读全文
posted @ 2023-06-15 09:34
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本文主要内容如下，基本涉及了cache的概念，工作原理，以及保持一致性的入门内容。 1 为什么需要Cache 1.1 为什么需要Cache 我们首先从一张图来开始讲为什么需要cache. 上图是CPU性能和Memory存储器访问性能的发展。我们可以看到，随着工艺和设计的演进，CPU计算性能其实发生了 阅读全文
posted @ 2023-06-11 11:33
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IEC 60958 && IEC 61937 IEC 60958 IEC 60958是一种传递数字音频的接口规范，相比I2S，IEC60958通过一根线同时传递时钟信号和数据信号。IEC 60958用来传递两channel，16/20/24bits采样深度的PCM数据。 IEC 60958在传输数据 阅读全文
posted @ 2023-05-25 11:28
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主流的CMOS和CCD sensor几乎都是输出Bayer mosaic格式的RAW数据，这种数据格式是无法直接观看的，必须转换成常见的RGB或YUV格式才能被主流的图像处理软件支持。对于camera产品而言，一般还需要将RGB或YUV图像进一步转换成JPEG格式以方便进行存储。 上述图像处理过程统 阅读全文
posted @ 2023-05-25 11:26
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Spyglass CDC工具使用 执行SpyGlass CDC 分析 执行SpyGlass CDC 分析包含执行CDC验证，CDC验证是指检测设计中的CDC问题。如果需要进行CDC校验，请执行以下步骤。 1.设置所需参数。关于SpyGlass CDC解决方案的所有参数，请参见“SpyGlass CD 阅读全文
posted @ 2023-05-19 14:57
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经常，一些性能测试人员对延时（Latency）、吞吐（Throughput）、带宽（Bandwidth）和响应时间（Response Time）感到迷惑，今天，就用一些简单的例子来说明它们之间的区别。 从上图（水管示意图），基本可以看出三个重要组件：延时（Latency）、吞吐（Throughput 阅读全文
posted @ 2023-05-19 10:53
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CDC与亚稳态 Clock Domain Crossing (CDC) : 跨时钟域设计中，信号adat从aclk domain传播到bclk domain；aclk与bclk之间的频率，相位没有固定关系，为asynchronous异步关系的时钟。 Metastability: 当adat在bclk 阅读全文
posted @ 2023-05-19 08:57
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同步复位和异步复位 复位信号在数字电路里面的重要性仅次于时钟信号。对一个芯片来说，复位的主要目的是使芯片电路进入一个已知的，确定的状态,主要是触发器进入确定的状态。在一般情况下，芯片中的每个触发器都应该是可复位的。在某些情况下，当在高速应用程序中使用流水线触发器(移位寄存器触发器)时，为了实现更高的 阅读全文
posted @ 2023-05-19 07:59
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FPGA 内部资源介绍 FPGA芯片主要由6部分完成，分别为：可编程输入输出单元、基本可编程逻辑单元、完整的时钟管理、嵌入块式RAM、丰富的布线资源、内嵌的底层功能单元和内嵌专用硬件模块。 CLB(configurable logic block) Artix 7系列CLB提供高级、高性能FPGA逻 阅读全文
posted @ 2023-05-17 13:19
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傅里叶级数 周期函数 满足条件：$f(x+T)=f(x)$ 的函数称为周期函数，其中 $T $称为该函数的最小正周期。 周期函数的性质 (i)若$T$ 为一周期函数$f(x)$的周期，那么$kT,k{\in}R$ ， 也为$f(x)$的周期。若$T_1,T_2$都为$f(X)$的周期，那么 $k_1 阅读全文
posted @ 2023-05-17 08:49
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