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BL产生的原因 暗电流 暗电流（dark current），也称无照电流，指在没有光照射的状态下,在太阳电池、光敏二极管、光导电元件、光电管等的受光元件中流动的电流，一般由于载流子的扩散或者器件内部缺陷造成。目前常用的CMOS就是光电器件，所以也会有暗电流，导致光照为0的时候也有电压输出。 如图是二 阅读全文
posted @ 2023-07-18 21:41
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除法器 与乘法相比，除法的实现较为复杂，运算过程如下： 过程： 被除数和余数：将余数和被除数视为一个，共享一个寄存器，初始值为被除数 除数：可视为不断右移，并和被除数相减 商：每个bit依次生成，可视为不断左移 除法器的工作流程 要注意的是，与手算相比，电路实现总是将余数减除数，所以如果出现差小于0 阅读全文
posted @ 2023-07-17 14:21
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乘法器 顺序乘法器 我们需要明确的是两个D_WIDTH位宽的数相乘，结果位宽为2*D_WIDTH, 对于负数乘法，可以利用乘数和被乘数的符号位进行异或得到积的符号位，通过判断符号位得到乘数和被乘数的绝对值，将负数乘法转为无符号数乘法进行运算，首先初始化乘数寄存器和被乘数寄存器Multiplicand 阅读全文
posted @ 2023-07-17 13:47
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减法器 半减器 半减器用于计算两比特Xi和Yi的减法，输出结果Di和向高位的借位Bo（Borrow output）。其真值表、逻辑表达式、Verilog描述和门电路图如下： module half_subtract( input xi, input yi, output di, output bo) 阅读全文
posted @ 2023-07-17 13:38
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加法器 1.1 半加器 半加器用于计算2个单比特二进制数a与b的和，输出结果sum（s）和进位carry（c）。在多比特数的计算中，进位c将作为下一相邻比特的加法运算中。单个半加器的计算结果是2c+s。其真值表、逻辑表达式、verilog描述和电路图分别如下所示。 逻辑表达式： $$s=a'b |a 阅读全文
posted @ 2023-07-17 11:32
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1.数的表示 1.1 数制转换 十进制整数转换成其他进制数：“除基取余”：十进制整数不断除以转换进制基数，直至商为0。每除一次取一个余数，从低位排向高位。 十进制小数转换成其他进制数：乘基取整，直至ε，高位到低位；“乘基取整”：用转换进制的基数乘以小数部分，直至小数为0或达到转换精度要求的位数。每乘 阅读全文
posted @ 2023-07-15 11:36
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循环语句 在Verilog HDL中存在着四种类型的循环语句，用来控制执行语句的执行次数。 1) forever 连续的执行语句。 2) repeat 连续执行一条语句 n 次。 3) while 执行一条语句直到某个条件不满足。如果一开始条件即不满足(为假)，则语句一次也不能被执行。 4) for 阅读全文
posted @ 2023-07-14 15:34
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task模块 任务task在模块中任意位置定义，并在模块内任意位置引用，作用范围也局限于此模块。 模块内子程序出现下面任意一个条件时，则必须使用任务而不能使用函数。 1）子程序中包含时序控制逻辑，例如延迟，事件控制等 2）没有输入变量 3）没有输出或输出端的数量大于 1 //任务task定义：如下代 阅读全文
posted @ 2023-07-14 15:32
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固定模式噪声消除 (Fixed Pattern Noise Remove) 由于 Sensor 工艺的原因导致了 Sensor 会在固定的位置产生相对固定的随时间变化较小的噪声，称之为固定模式噪声。固定模式噪声一般出现于 CMOS Sensor，并且 Sensor的模拟增益或者列增益开的越大，固定模 阅读全文
posted @ 2023-06-22 17:52
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摘要：
坏点检测/消除 (Defect Pixel Detection/Correction) 与FPN 类似，坏点的产生也与 Sensor 的工艺有关。与FPN 不同的是，坏点有固定点和疑似坏点两种。而后者的出现相对不固定，会随着曝光时间以及温度的变化而变化。因此进行坏点消除之前需要首先进行坏点检测 (D 阅读全文
posted @ 2023-06-22 17:51
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