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功能 1. 单axi-stream 接口输入(10bit raw输入),axis输出(10bit输出)。 2. 使用xilinx hls 编写。 支持 支持xilinx 所有系列fpga 阅读全文
posted @ 2022-11-06 19:05
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功能 1. 单axi-stream 接口输入(10bit raw输入),axis输出(10bit输出)。 编辑 2. 使用xilinx hls 编写。 编辑 3. 配置寄存器有 #pragma HLS INTERFACE s_axilite port=blacklevelr #pragma 阅读全文
posted @ 2022-11-06 17:35
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功能 1. 单axi-stream 接口输入,axis输出。(10bit rbg输入,10bit rbg输出。) 编辑 2. 使用xilinx hls 编写。 编辑 3. 配置寄存器有 #pragma HLS INTERFACE s_axilite port=width //宽度 #prag 阅读全文
posted @ 2022-11-06 12:53
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功能 1. 单axi-stream 接口输入,axis输出。(10bit rbg输入,10bit rbg输出。) 编辑 2. 使用xilinx hls 编写。 编辑 2022/10/27 优化。 编辑 3. 配置寄存器有 #pragma HLS INTERFACE s_axilite po 阅读全文
posted @ 2022-11-06 12:53
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功能 1. 单axi-stream 接口输入,axis输出。(10bit rbg输入,10bit rbg输出。输入为大分辨率,输出为小分辨率) 编辑 2. 使用xilinx hls 编写。 编辑 20221027 优化 编辑 3. 配置寄存器有 #pragma HLS INTERFACE 阅读全文
posted @ 2022-11-06 12:52
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功能 1. 单axi-stream 接口输入,axis输出。( y8bit输入,8bit yuv输出) 编辑 2. 使用xilinx hls 编写。 编辑 20221027 优化 编辑 3. 配置寄存器有 #pragma HLS INTERFACE s_axilite port=heigh 阅读全文
posted @ 2022-11-06 12:51
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功能 1. 单axi-stream 接口输入,axis输出。( 10bit rbg输出) 编辑 2. 使用xilinx hls 编写。 编辑 3. 配置寄存器有 #pragma HLS INTERFACE s_axilite port=height //宽 #pragma HLS INTER 阅读全文
posted @ 2022-11-06 12:51
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功能 1. 单axi-stream 接口输入(10bit raw输入),axis输出(rgb10bit输出)。 编辑 2. 使用xilinx hls 编写。 编辑 3. 配置寄存器有 #pragma HLS INTERFACE s_axilite port=height //宽 #pragm 阅读全文
posted @ 2022-11-06 12:50
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功能 1. 双axi-stream 接口输入,大分辨率axis为底图,axis为顶图。 目前输入为rbg分量输入,各分量为10bit 编辑 2. 使用xilinx hls 编写。资源利用率不高。mixer ip 基本类似。 编辑 20221026 进行优化。 编辑 3. 配置寄存器有 #p 阅读全文
posted @ 2022-11-06 12:49
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