摘要：
pll时钟延迟为问题这关系到pll的工作方式，如果pll内部使用的是鉴频器，则输入和输出将没有固定的相位差，就是每次锁定都锁定在某个相位，但每次都不一样。如果使用的是鉴相器，则输入和输出为0相位差。早期的器件内部为前者，但现在已经基本绝迹了。因此在不考虑抖动，在pll... 阅读全文
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转自http://www.cnblogs.com/s_agapo/archive/2012/04/08/2437775.html凡是做模拟信号采集的，很少不涉及BT.656标准的，因为常见的模拟视频信号采集芯片都支持输出BT.656的数字信号，那么，BT.656到底是... 阅读全文
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led 液晶本身不发光，而是有背光作为灯源，白色是由红绿蓝三色组成，黑色是，液晶挡住了led灯光穿过显示器。lcd比led更薄。oled：显示黑色时，灯是灭的，所以显示黑色更深，效果更好。这就不得不说一下中美显示器电视显示扫描的区别，“隔行扫描”和“逐行扫描”。逐行扫... 阅读全文
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引用http://www.cnblogs.com/alifpga/p/9292588.htmlFPGA作为通信、航天、军工等领域的关键核心器件，是保障国家战略安全的重要支撑基础。近年来，随着数字化、网络化和智能化的发展，FPGA的应用领域得到快速扩张。美国在FPGA领... 阅读全文
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都是随机存储器，断电数据消失，但Flash有点不一样，它在消失数据之前，添加了一个“”性质“，这个性质能上电后再识别，且把这个信号返回到ram中，这样近似的把flash当成了eeprom来使用，就是这样，RAM芯片断电后数据会丢失，Flash芯片断电后数据不会丢失，但... 阅读全文
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转载：https://blog.csdn.net/weiweiliulu/article/details/236667171、M25P16概述 M25P16是一款带有先进写保护机制和高速SPI总线访问的2M字节串行Flash存储器，该存储器主要特点：2M字节的存... 阅读全文
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创建clk的ip核以及设置PLL的时钟输出原理：外部晶振输入50M的频率，由ip核输出想要的频率1、新建工程model再在“芯片”名称上建立clk的ip核2、设置输入写为50M3、设置想要的频率可多选4、之后完成即可 调用实例化pll_ip5、程序`timescale... 阅读全文
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目的：做一个3输入，1输出模块；其中只要有2个输入为1则输出为1；1、打开vivado创建一个工程2、选择保存路径和名称3、选择创建rtl文件且勾选下面的选项4、选择芯片如xc7a35tift5、进入主界面打开设置勾选-bin文件6、创建源文件并命名为test7、fi... 阅读全文
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1．任务定义 任务定义的形式如下： task task_id; [declaration] procedural_statement endtask 其中，关键词 task 和 endtask 将它们之间的内容标志成一个任务定义，task 标志着一个任... 阅读全文
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板子使用的是黑金的是xilinx spartan—6开发板，首先准备一份24LC04B芯片资料，读懂资料后列出关键参数。如下:1、空闲状态为SDA和SCL都为高电平2、开始状态为：保持SCL，SDA高电平不变，SDA 保持最少4us，之后SDA为低，保持最少4us3、... 阅读全文