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2018年7月16日
FPGA中iic总线上,应答ACK解析
摘要: 首先要明白一点,有效ACK是指第9位为低电平,第十位,十一位就管不着了,(我写的代码发现第九位为低电平,之后复位为高电平,开始没注意后来搞的很是头痛) 主机发ack和主机检测ack,主机发ack是在从机发数据给主机的时候,主机检测ack是在主机发完一个字节后从机发的...
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posted @ 2018-07-16 20:24 万大帅
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2018年7月14日
网络信息的传输过程
摘要: 转自:https://zhidao.baidu.com/question/487510936.html比如你用QQ发送文本信息“你好”给对方。发送过程:1、QQ先把“你好”转换成ASCII码,并且生成一个报文,此时报文为:(QQ报文头)+(你好的ASCII码)2、QQ...
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posted @ 2018-07-14 10:07 万大帅
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2018年7月1日
verilog 除法器
摘要: verilog 除法器:利用二进制的除法翻译过来的硬件电路1.1 实现算法基于减法的除法器的算法: 对于32的无符号除法,被除数a除以除数b,他们的商和余数一定不会超过32位。首先将a转换成高32位为0,低32位为a的temp_a。把b转换成高32位为b...
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posted @ 2018-07-01 22:30 万大帅
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2018年6月30日
二进制 转换成十进制 BCD码(加3移位法)
摘要: “原来的二进制数十几位,则左移时就要左移几位” "二进制数调整BCD码的方法是将二进制码左移8次,每次移位后都检查低四位LSD+3是否大于7,如是则加3,否则不加,高4位MSD作同样处理"一、为什么左移8次原寄存器是存二进制数的,新寄存器是存十进制数的,当然要左移8...
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posted @ 2018-06-30 20:54 万大帅
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2018年6月27日
关于Verilog中begin-end & fork-join
摘要: 转载:http://blog.sina.com.cn/s/blog_6c7b6f030101cpgt.htmlbegin-end and fork-join are used to combine a group of statements in a single...
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posted @ 2018-06-27 15:41 万大帅
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2018年6月26日
spi、iic、can高速传输速度与选择
摘要: uart: 无限制,常用9600、115200bps等保证双方通信速度相同。iic: 通讯速率400Kbpscan: 一般为1MbpsSPI: 通信速率 fosc/4其传输速度可达几Mb/s缺点:抗干扰能力差。SPI采用的是单端非平衡的传输方式,即...
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posted @ 2018-06-26 15:51 万大帅
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2018年6月22日
STM32定时器时间的计算方法
摘要: 本文出自:https://wenku.baidu.com/view/e3bdfb7601f69e31433294c4.htmlSTM32定时器时间的计算方法STM32中的定时器有很多用法:(一)系统时钟(SysTick)设置非常简单,以下是产生1ms中断的设置,和产生...
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posted @ 2018-06-22 09:32 万大帅
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2018年6月13日
Verilog HDL中的运算符关系
摘要: 1,位运算符 按位运算的运算符是位运算符,原来的操作数有几位,结果就有几位,若两个操作数位数不同,则位数短的操作数左端会自动补0。 (1),按位取反:~ (2),按位与:& (3),按位或:| (4),按位异或:^ (5),按位同或:^~或~^ 2,缩位运算符(又称...
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posted @ 2018-06-13 10:41 万大帅
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2018年5月30日
正点原子stm32f103mini版串口下载BOOT0引脚与与CH340G芯片引脚RTS、DTR、的关系原理
摘要: 在做串口实验时,一直搞不明白一键下载是怎么回事,于是自己就去捉摸CH340G这块芯片,那么这里我将详细的讲解一下这块芯片怎么与stm32配合使用的。1、由CH340G芯片资料可以知道这两个引脚的功能都为输出RTS#:信号输出,初始状态为高电平,表示芯片...
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posted @ 2018-05-30 15:08 万大帅
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