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2022年2月22日
编译指令
摘要: 总结cc的编译选项
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posted @ 2022-02-22 10:25 Vinson88
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2022年2月11日
谁的傅里叶变换是阶跃函数?
摘要: 推导得到"频域阶跃函数”的傅里叶反变换
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posted @ 2022-02-11 18:19 Vinson88
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2022年2月9日
常用傅里叶变换对($t \rightarrow \omega$)
摘要: 常见傅里叶变换对的推导
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posted @ 2022-02-09 13:28 Vinson88
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傅里叶变换的性质
摘要: 总结推导傅里叶变换的性质
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posted @ 2022-02-09 13:24 Vinson88
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2022年1月29日
周期函数的傅里叶级数以及非周期函数的傅里叶变换推导
摘要: 详细推导了傅里叶级数以及傅里叶变换
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posted @ 2022-01-29 11:30 Vinson88
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2022年1月20日
累加器
摘要: 累加运算 1. 累加原理 累加运算如式(1)所示: $$ s = \sum_{n=0}^{L-1}a_{n} \tag{1}$$ 它表示N个数相加。累加运算由累加器实现,其实质是完成一系列的加法运算,但是与简单的加法运算不同,他需要将前一次运算的结果反馈至输入端,作为新一次加法运算的加数,如式(1)
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posted @ 2022-01-20 13:39 Vinson88
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2022年1月18日
乘法器原理与硬件实现
摘要: # 乘法运算 乘法运算在数字信号处理中被广泛应用,如滤波器以及各种变换等。这里讨论乘法器的各种设计方法。尽管Verilog语言中有关键字signed(没有unsingned),借助其可方便地用"$*$"描述无符号数乘法和有符号乘法,但同样可根据目标需求(速度优先还是资源优先)采用其他方式实现乘法运算
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posted @ 2022-01-18 16:21 Vinson88
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2022年1月17日
Verilog对数据进行四舍五入(round)与饱和(saturation)截位
摘要: 1. 引言 在利用Verilog写数字信号处理相关算法的过程中往往需要对数据进行量化以及截位。而在实际项目中,一种比较精确的处理方式就是先对截位后的数据进行四舍五入(round),如果在四舍五入的过程中由于进位导致数据溢出,那么我们一般会对信号做饱和(saturation)处理。所谓饱和处理就是如果
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posted @ 2022-01-17 16:31 Vinson88
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2022年1月16日
加法器的硬件实现
摘要: 详细描述加法器的硬件实现原理以及结构
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posted @ 2022-01-16 20:32 Vinson88
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2022年1月15日
如何将二进制补码转换为十进制数
摘要: 十进制转二进制补码 我们知道将十进制数转换为二进制补码的方法是: 判断其是负数还是正数 将其转换为二进制 如果是正数,那么补码到此处就求出来了 如果是负数,还需要在保持符号位不变的情况下将其余位取反然后加一 还有一种方法: 假定所需转换的数字为 \(a_{(10)}\) 下标表示这个数是十进制。如果
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posted @ 2022-01-15 18:02 Vinson88
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