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Yiyang Yuan (袁易扬) Research Interests Compute-In-Memory, Resistive Random Access Memory, Artificial Intelligence, Brain-Machine Interface Education Sep 阅读全文
posted @ 2022-09-21 20:18
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序言 其实蹦出来写这篇文章的想法的时间是挺久之前的，ai coding这两年的发展挺迅猛的，已经迭代了好几个范式。我感觉自己其实属于比较早开始入坑ai coding的人，早在23年那会就写过一篇博客，不过后来因为大部分的项目开发要在内网环境下进行，有一阵子没怎么follow这块的新进展，直到今年去业 阅读全文
posted @ 2025-10-30 02:07
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7-9三个月里连着处理了很多事情的ddl，总结下来是写了两篇论文的大修，一篇会议还有一篇论文的小修。总算是强撑到告一段落，惯例的做一些复盘和总结。 如题，主要是想做两方面问题的分析，第一个是如何有效的管理工作节奏，避免出现多个ddl扎堆的情况；第二个是如果真的不幸面对这样的局面，该如何有效的管理好自 阅读全文
posted @ 2025-09-30 17:37
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单纯的systemc很好懂，最朴素的systemc语法就是拿cpp当rtl写： https://www.cnblogs.com/sasasatori/p/17865550.html https://www.cnblogs.com/sasasatori/p/17899997.html 但实际上这样做并 阅读全文
posted @ 2025-09-07 00:33
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systolic array（SA）即脉动阵列。对于大规模的乘累加运算，SA将单个乘累加单元和数据流控制部件组成的process element（PE）进一步组织成大规模阵列，数据在PE之间打拍脉动传输。由于深度学习时代，计算负载以大规模的general matrix multiplication（ 阅读全文
posted @ 2025-08-14 21:44
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同时在业界和学界两边做事已经两个月了，简单聊聊感想。 首先是做事的根本逻辑有差异，业界对结果要付很大的责任，不管是项目对上游/下游交付，还是最后出产品，对结果的关注度>>>其他，能不能对上spec，能不能合规合标是最关键的；学界更多是需要一个“idea，方法，效果”故事的close loop，对re 阅读全文
posted @ 2025-08-03 23:18
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Synopsys PrimteTime工具除了可以用来评估时序之外，也可以用来评估功耗。 一般来讲，PTPX进行功耗评估的流程如下： 使用电路网表进行仿真，可以是综合网表，也可以是PR后的网表 dump波形，可以用vcd或者fsdb格式 PTPX吃入标准单元/ip库，网表，sdc和sdf文件以及波形 阅读全文
posted @ 2025-07-17 17:43
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存算目前的演进趋势是从bit serial变成了bit parallel，即乘法操作从1b*nb变成了nb*nb，并消除掉了原先bit serial设计中的累加器，值得一提的是tsmc那边的结论是等吞吐率情况下，加法树功耗接近，但移位累加的开销显著的少，因此bit parallel在ppa上全面优于 阅读全文
posted @ 2025-06-28 22:48
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gem5基础介绍 gem5的官网： https://www.gem5.org/ gem5的官方入门教程： https://www.gem5.org/getting_started/ https://www.gem5.org/documentation/learning_gem5/introducti 阅读全文
posted @ 2025-06-24 22:59
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前言 直到2022年之前，基本上CIM技术支持的数制都以定点数为主导，大致经过了一个从低精度（INT1到INT4）到高精度（INT8为主流）的发展过程，不过定点只能用在推理场景，基本上没法搞定训练，于是2022年的ISSCC上出现了一篇浮点数字CIM的代表作[1]。随后由于CIM基本上卷无可卷，折腾 阅读全文
posted @ 2025-06-18 22:14
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背景 gem5是当前体系结构研究领域的常用开源仿真器，可以提供从系统级到微架构级的建模与验证功能。 通过gem5可以快速搭建一个有着memory hierarchy和可执行代码的cpu的系统级仿真框架，从而进行系统级评估，以解决当下论证存算一体优势时，benchmark和指标存在片面性的问题。 安装 阅读全文
posted @ 2025-06-14 15:58
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挖了个新坑，在github上开了个项目：https://github.com/sasasatori/APBRST/tree/main APBRST: 基于Pyverilog的RTL到文档翻译工具 作者: sasasatori, 联系方式: 2861704773@qq.com 序言 APBRST旨在帮 阅读全文
posted @ 2025-04-24 20:00
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1. 绪论 DeepSeek在24-25年相交之际一轮爆火，通过强大的模型性能和极低的token价格在众多厂商的大模型中杀出重围，一跃成为LLM圈子里的顶流，大方的技术报告和开源更是进一步增强了其影响力。其实在DeepSeek火爆之际就想好好研读一下他们发布的论文，但是那会忙于流片一直没能抽出时间， 阅读全文
posted @ 2025-04-23 23:48
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前言 做了很久的CiM电路，但一直感觉缺乏一套全栈式的仿真建模工具，因此有必要对目前公开发表的各类CiM仿真建模工具进行调研。 这次综述主要的目标是调研一些关联性比较强的工作，简述这些工作的核心idea以及适用场景，最后会对这些工作做一个比较系统的summary。 CiMLoop CiMLoop[1 阅读全文
posted @ 2025-04-20 23:24
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CiMLoop：一个灵活、准确、快速的存内计算建模工具 最近在推进CiM仿真器方面的工作，其中MIT发表的CiMLoop工作之前就在关注，但一直没有沉下心好好研读过，现在抽出一些时间来好好的阅读和分析一下。 摘要 存内计算是一个加速神经网络的潜力方案，因为其可以避免高能耗的权重数据搬运，并且使用存储 阅读全文
posted @ 2025-04-14 18:56
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简单做个summary手册，方便后面查阅以及组里统一规范。 全定制电路Flow手册 编写人：袁易扬 联系方式：2861704773@qq.com 文档版本 编写日期 说明 v1.0 2025.3.27 初次发布 1. 工具链 原理图： Cadence Virtuoso IC617/618（用于22n 阅读全文
posted @ 2025-04-02 00:25
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上午刚听完ICAC陈老师分享的chiplet封装技术分享，学到很多，简单做了一下笔记。 2.5d封装: silicon interposet（直接用硅做die到基板的互联中介，密度高，性能好，价格贵），rdl interposer（用聚乙烯胺，环氧树脂等有机材料做互联中介，密度相对低，但价格便宜）， 阅读全文
posted @ 2025-03-26 14:47
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又结束一轮惊心动魄的流片。 其实本轮流片的困难事先可以预想到，因为本来时间点就比较的极限，从去年10月开始立项，idea到芯片完整实现总共只有5个月时间，中间还隔了个过年以及ISSCC，而且还上的是第一次接触的先进工艺，极大概率要在熟悉工艺上消耗额外的时间，不像去年的流片能吃到对工艺熟悉的红利。 但 阅读全文
posted @ 2025-03-12 23:08
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做macro lef的时候基本的flow以前写博客时简单介绍过，详见这篇。 还有一些小的tips要注意，直接用virtuoso出的lef并不完善。 MACRO macro CLASS BLOCK ; # 单元分类（CORE/BLOCK等） FOREIGN macro 0 0 ; # 外部引用坐标偏移 阅读全文
posted @ 2025-02-26 23:01
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有时在一些情况下获取不到ip的gds文件，只能拿到lef。或者是需要使用lef文件查看一下数字pr时吃进去的形状是什么样的，这时就需要进行lef转gds。 lef转gds可以使用calibre的fdi2gds实现，命令为： fdi2gds -system LEFDEF -lef techlef.le 阅读全文
posted @ 2025-02-06 16:36
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最近流片很累很焦虑，放松心情找篇讲\(g_m/I_D\)设计法的文档翻译一下： 《A Basic Introduction to the gm/ID-Based Design Methodology》 1. 摘要 该文章向读者介绍了基于\(g_m/I_D\)的设计方法学，用于帮助CMOS模拟电路设计 阅读全文
posted @ 2025-02-06 01:11
sasasatori
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