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Hdlbits的习题文章前前后后做了几遍，每一次都有不一样的感受，题目按照顺序正在整理，截止Circuis->Sequential Logic->Counters这部分之前，练习的文章见我的博客的文章部分，从Counters开始，我将练习的文章迁移至我的博客的随笔部分。 完成了代码的练习，再过一段时 阅读全文
posted @ 2024-04-10 14:43
江左子固
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1. 在运行程序时，报错如下： usage: run.py [-h] --model MODEL [--embedding EMBEDDING] [--word WORD] run.py: error: the following arguments are required: --model 答： 阅读全文
posted @ 2024-04-09 19:36
江左子固
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命令行： sudo apt update sudo apt install verilator git clone --progress https://github.com/qleenju/PDPU.git cd PDPU verilator -Wall --cc sources/pdpu_top 阅读全文
posted @ 2025-05-12 23:05
江左子固
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操作： git clone --progress --verbose https://github.com/stillwater-sc/universal.git mkdir build cd build cmake .. cmake --build . -- -j$(nproc) 列出所有可执行文 阅读全文
posted @ 2025-05-09 23:44
江左子固
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继续分析 comp_tree.sv 中第 21–40 行内容，这部分实现： 2 输入时使用 comparator 完成比较 输入数 > 2 时，递归调用 comp_tree 模块自身 🔧 行 21–23：比较两个输入 .operand_a(operands_i[0]), .operand_b(op 阅读全文
posted @ 2025-05-04 17:50
江左子固
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我们开始分析 csa_tree.sv 的前 20 行，这是一个递归式 Carry-Save Adder Tree 模块，用于将任意数量的同位宽输入压缩为两组：sum 和 carry。 🧾 第 1 行：功能注释 // Recursive implementation of carry-save-ad 阅读全文
posted @ 2025-05-04 17:45
江左子固
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我们来分析 fulladder.sv 文件，它是一个标准的三输入全加器模块，通常用于构建 3:2 压缩器（compressor） 的基本单元。 📘 功能注释 // full adder, the basic module that constitutes the 3:2 compressor 该模 阅读全文
posted @ 2025-05-04 17:24
江左子固
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我们开始逐行分析 booth_encoder.sv 的前 20 行，这是一个 Radix-4 Booth 编码译码器模块，用于将 3 位编码信号转换为控制信号 neg, zero, one, two。 🧾 第 1–11 行：功能注释（Booth 编码规则表） /* The radix-4 boot 阅读全文
posted @ 2025-05-04 17:22
江左子固
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我们开始逐行分析 radix4_booth_multiplier.sv 的前 20 行代码，该模块实现了一个 基于改进型 Radix-4 Booth 编码和 Wallace 树压缩的乘法器，适用于高速乘法运算。 🧾 第 1 行：模块功能说明 // Modified radix-4 booth wa 阅读全文
posted @ 2025-05-04 17:21
江左子固
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我们开始对 posit_decoder.sv 文件的前 20 行进行逐行分析。该模块的功能是将一个 N 位的 Posit 编码解码为：符号位、regime+exponent、尾数（mantissa）。 📝 第 1 行：模块说明 // Posit decoder 📘 说明该模块用于将 Posit 阅读全文
posted @ 2025-05-04 17:04
江左子固
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我们开始逐行分析 gen_prods.sv 的前 20 行。该模块是 Booth 乘法器的中间层模块，用于批量调用 gen_product 子模块，根据 Booth 编码生成所有 部分积（partial products）。 📝 第 1 行：功能注释 // Generate partial pro 阅读全文
posted @ 2025-05-04 16:50
江左子固
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我们开始逐行分析 gen_product.sv 文件的前 20 行。该模块用于根据 Booth 编码结果生成一个部分积（partial product），这是 Booth 乘法器流水线中的关键步骤之一。 📝 第 1 行：模块说明 // Generate partial product accord 阅读全文
posted @ 2025-05-04 16:39
江左子固
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