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拒绝思维懒惰,习惯深度思考,提升认知水平。

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2018年9月4日

Specify 的含义 ------ 转载

摘要: specify block用来描述从源点(source:input/inout port)到终点(destination:output/inout port)的路径延时(path delay),由specify开始,到endspecify结束,并且只能在模块内部声明,具有精确性(accuracy)和 阅读全文

posted @ 2018-09-04 14:24 hxing 阅读(2465) 评论(0) 推荐(2)

2018年8月3日

关于CPU CACHE工作机制的学习

摘要: 转自:http://blog.csdn.net/notbaron/article/details/48143409 1. 存储层次结构 由于两个不谋而合的因素如下: l 硬件:由于不同存储技术的访问时间相差很大。速度较快的技术每个字节的成本要比速度较慢的技术高,而且容量小。CPU和主存之间的速度差距 阅读全文

posted @ 2018-08-03 23:27 hxing 阅读(312) 评论(0) 推荐(0)

关于CPU Cache -- 程序猿需要知道的那些事

摘要: 本文原文地址:http://cenalulu.github.io/linux/all-about-cpu-cache/ 先来看一张本文所有概念的一个思维导图 为什么要有CPU Cache 随着工艺的提升最近几十年CPU的频率不断提升,而受制于制造工艺和成本限制,目前计算机的内存主要是DRAM并且在访 阅读全文

posted @ 2018-08-03 23:22 hxing 阅读(336) 评论(0) 推荐(0)

ARM920T的Cache

摘要: 转载自:http://www.eefocus.com/mcu-dsp/242034 ARM920T有16K的数据Cache和16K的指令Cache,这两个Cache是基本相同的,数据Cache多了一些写回内存的机制,后面我们以数据Cache为例来介绍Cache的基本原理。我们已经知道,Cache中的 阅读全文

posted @ 2018-08-03 23:16 hxing 阅读(452) 评论(0) 推荐(0)

Cache基本原理之:结构

摘要: 转载自:https://www.jianshu.com/p/2b51b981fcaf Cache entries 数据在主存和缓存之间以固定大小的”块(block)”为单位传递,也就是每次从main memory读取的最小数据的单元。每个块的大小可能是4,8,16 Bytes或其他值,不同的CPU不 阅读全文

posted @ 2018-08-03 23:15 hxing 阅读(2223) 评论(0) 推荐(0)

2018年6月7日

systemverilog assertion

摘要: 1.一般是单独写一个module 里面放assertion, 然后在验证平台顶层和RTL的实例化bind起来​ 2. |->表示直接进行判断,|=>表示下一拍判断,一般一个断言最好只写一个蕴含。​ $rose()表示该信号当前拍为1,上一拍为0,作用与 miso_oe && !past(miso_o 阅读全文

posted @ 2018-06-07 17:11 hxing 阅读(1685) 评论(0) 推荐(0)

如何查看安装python和numpy的版本

摘要: 命令行下查看python和numpy的版本和安装位置 1、查看python版本 方法一: python -V 注意:‘-V‘中‘V’为大写字母,只有一个‘-’ 方法二: python --version 注意:‘--version'中有两个‘-’ 2、查看python安装位置 方法一: python 阅读全文

posted @ 2018-06-07 10:56 hxing 阅读(36086) 评论(0) 推荐(0)

2018年5月1日

winCVS 使用的一个小要点

摘要: 对于版本管理软件CVS,可以在Linux中使用命令来管理。 但是 在windows 界面下,也可以使用 winCVS 工具来管理。 现在 讲一下 如何 在 winCVS 登陆 CVS 帐号 和 密码: 打开 winCVS ,然后在 Admin 菜单下 选择 Login ,出现 如下图的 界面。 在红 阅读全文

posted @ 2018-05-01 21:07 hxing 阅读(291) 评论(0) 推荐(0)

Spyglass CDC工具使用(一)

摘要: 最近一直在搞CDC (clock domain crossing) 方面的事情,现在就CDC的一些知识点进行总结。 做CDC检查使用的是Spyglass工具。以下内容转载自:Spyglass检查之CDC(1) | 码农家园 (codenong.com) 文章目录 读入设计 约束文件 CDC流程 本文 阅读全文

posted @ 2018-05-01 20:30 hxing 阅读(2245) 评论(0) 推荐(0)

2018年4月15日

FPGA editor 的使用之一 ------ Probe探针

摘要: 做FPGA设计经常会用到FPGA editor工具,今天开始总结下使用FPGA editor工具的经验。 1、添加probes 在debug时,经常要分析设计中的某一个信号的状态变化,需要观测这个信号,重新做FPGA版本又耗时太长。 这时FPGA editor能够很方便的实现这一需求。运用探针Pro 阅读全文

posted @ 2018-04-15 17:18 hxing 阅读(968) 评论(0) 推荐(0)

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