摘要：
简介： 对于写在秋招简历上的项目，本人在此进行一些讲解和分析；其中讲解主要包括： 基于FPGA实现的多通道视频采集卡（2023年集创赛FPGA赛道题目）多通道车载自动驾驶传感器数据采集系统（实验室项目）UDP协议万兆以太网收发及FPGA验证（个人项目）这三个项目之中的模块。一些模块在多个项目中都存在 阅读全文
posted @ 2024-08-30 17:07
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摘要：
整个实现可以分解为三个关键部分： 宏本身： 发起注册请求。 注册函数 (register_super_type): 记录类型关系。 回调执行引擎 (uvm_do_callbacks): 查询并使用记录的关系。 下图清晰地展示了这三个部分如何协同工作，实现回调继承： 图表 代码 flowchart T 阅读全文
posted @ 2025-08-21 15:33
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摘要：
set_type_override_by_type 全部重载 set_type_override_by_type(parrot::get_type(), bird::get_type()); set_inst_override_by_type 按路径重载，重载路径下的某个component set_ 阅读全文
posted @ 2025-08-21 09:19
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摘要：
1. 增加vseq；2. global define/enum寄存器模型reg_model:1.寄存器模型的行为仍是由vseq控制的；2.case test中，寄存器模型需要完成create和connect等操作；例如，将寄存器模型的rm sequencer设置为env下的bus 寄存器sqr，以及 阅读全文
posted @ 2025-08-20 16:44
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摘要：
6.4.3匹配类型 一个sequencer只能产生一种类型的transaction，一个sequence如果要想在此sequencer上启动，那么其所产生的transaction的类型必须是这种transaction或者派生自这种transaction。那么有没有办法将两个截然不同的transact 阅读全文
posted @ 2025-08-19 14:05
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摘要：
`uvm_do `define uvm_do(SEQ_OR_ITEM) \ `uvm_do_on_pri_with(SEQ_OR_ITEM, m_sequencer, -1, {}) repeat (10) begin `uvm_do(m_trans) end `uvm_do_with `defin 阅读全文
posted @ 2025-07-31 19:41
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摘要：
UVC UVM verification component VIP verification IP 商业的，别人做好的，问题较少的IP，自己开发的一般叫UVC。 Reuse 考虑每一个component被取代的情况； 其中最关键的是agent的输入端的disable，passive； clock 阅读全文
posted @ 2025-07-30 20:02
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摘要：
run_test函数 使所有组件分阶段执行所有已注册的阶段。 如果提供了可选的 test_name 参数，或者找到了命令行加参数 +UVM_TESTNAME=TEST_NAME，则指定的组件将在分阶段执行之前创建。 测试可能包含新的验证组件或整个测试平台，在这种情况下，可以从命令行选择测试和测试平台 阅读全文
posted @ 2025-07-29 08:00
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摘要：
参考：sequence启动的三种方式 - 猪肉白菜_125 - 博客园 sequence的启动 seq的start通过传递sqr句柄实现启动； 但是这种方式将接口暴露在外，不被提倡。 启动以后，seq会调用uvm_do之类的宏向其传递的句柄开始发送事件给sqr； 而driver将通过TLM取得sqr 阅读全文
posted @ 2025-07-28 23:16
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摘要：
UVM 验证平台中所有的组件应该派生自UVM中的类； 每一个派生自uvm_component或其派生类的类在其new函数中要指明两个参数：name和parent，这是uvm_component类的一大特征。 uvm_driver是一个派生自uvm_component的类，所以也会有这两个参数。 一个 阅读全文
posted @ 2025-07-23 19:38
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摘要：
编写代理类； 代理基类必须包含用于创建对象的纯虚方法和用于返回类名的方法； 拓展的代理类需要实现参数化传递希望创建对象的类型和类名； 代理类的调用伴随着factory的调用； 当仿真时间为0时，编译器会发现代理类的me尚未被初始化，进而创建工厂对象，并返回工厂类的句柄； 然后代理类创建代理对象，调用 阅读全文
posted @ 2025-07-22 09:54
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