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摘要： 在 UVM 验证平台中，打印 transaction（事务）通常需要结合 UVM 的打印机制和事务的自定义信息输出。以下是常用的实现方法： 基础方法：使用 uvm_info 配合 sprint() transaction 通常继承于 uvm_sequence_item，而 uvm_sequence_ 阅读全文

摘要： uvm_reg_data_t 并不是一个 “类”（class），而是 UVM（Universal Verification Methodology，通用验证方法学）中定义的一种数据类型（typedef），用于表示寄存器的数据值，是寄存器操作中最常用的基础类型之一。 具体含义： uvm_reg_dat 阅读全文

摘要： 项目来源 https://github.com/courageheart/AMBA_APB_SRAM DUT 接口 该dut的功能很简单，只是提供寄存器读写 测试平台结构梳理 平台特色 未使用refm cfg文件管理 env_cfg 设置了一个env_cfg组件，在其实例化时将agent_cfg（本 阅读全文

摘要： from的简写 阅读全文

摘要： 汇总 Python4RTLVerification github：https://github.com/raysalemi/Python4RTLVerification/tree/examples2.0 《芯片验证日记》公众号文章：https://mp.weixin.qq.com/s/Chy595R 阅读全文

摘要： 方法一：使用urg处理后查看 urg处理，默认生成urgReport目录 urg -full64 -dir simv.vdb -report urgReport urg指令除了可以合并多个.vdb文件外，还可顺带生成覆盖率报告； 执行完成后，会生成一个urgReport文件夹，里面会有一系列的.ht 阅读全文

摘要： urg 是synopsys公司推出的一个用于合并和处理仿真覆盖率数据的工具。下面为你介绍 urg 的常见使用方式： 基本功能概述 urg 工具主要用于合并多个覆盖率数据库文件，生成综合的覆盖率报告。它支持多种覆盖率类型，像代码覆盖率（行覆盖率、分支覆盖率等）、功能覆盖率等。 常用选项及示例 合并覆盖 阅读全文

摘要： 项目来源 https://github.com/Lampro-Mellon/apb-uart-uvm-env DUT 接口 接口部分，框选为APB，负责寄存器读写，其余为uart。 寄存器 这些是DUT内部的寄存地址： 功能 配置地址为32'd16的寄存器，可启动一次串口数据发送，发送的数据内容与配 阅读全文

摘要： 前言 以一个实例的形式记录极致简化的TLM连接关系是什么样的。 连接关系 接口1的声明和实例化 声明 接口1的类型为uvm_analysis_port，注意#后需要带上trans的类型。 实例化 接口2的声明和实例化 以下内容出现在同一个类中 声明 声明前需要定义一个宏： 然后才是声明： 注意#内包 阅读全文

摘要： 摘要 在 SystemVerilog 里，const 关键字有着重要的作用，主要用于声明常量。以下从不同使用场景为你详细介绍其意义： 常量变量声明 当使用 const 声明一个变量时，该变量在初始化之后就不能再被修改，这有助于提高代码的安全性和可读性，避免意外的变量值修改。 示例代码 module 阅读全文