随笔分类 - Chisel3
摘要:https://mp.weixin.qq.com/s/2318e6VJ4wFGpWwBOmTikA Chisel数据类型(Data)与Module的绑定关系,根据Data的使用方式不同,而有多种绑定类型。 参考链接: https://github.com/freechipsproject/chise
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摘要:https://mp.weixin.qq.com/s/Jsy8P3m9W2EYKwneGVekiw 独热码相关的电路生成器。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src/main/scala/chisel3/ut
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摘要:https://mp.weixin.qq.com/s/TK1mHqvDpG9fbLJyNxJp-Q Mux相关电路生成器。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src/main/scala/chisel3/uti
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摘要:https://mp.weixin.qq.com/s/mO648yx4_ZRedXSWX4Gj2g 可以容纳不同类型的变量的向量。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src/main/scala/chisel3
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摘要:https://mp.weixin.qq.com/s/g85Si6n37D9PYfR5hEoRQQ 实现一个查找逻辑。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src/main/scala/chisel3/util/
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摘要:https://mp.weixin.qq.com/s/8lC8vQnBdKW9C39H0QFFkA 对数相关的辅助方法,Math通过软件方法实现,CircuitMath通过硬件方法实现。 参考链接: https://github.com/freechipsproject/chisel3/blob/m
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摘要:https://mp.weixin.qq.com/s/DSdb4tmRwDTOki7mbyuu9A 实现16位线性反馈移位寄存器。可用于生成简单的伪随机数。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src
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摘要:https://mp.weixin.qq.com/s/MQzX1Ned35ztz0vusPdkdQ 比特相关的操作。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src/main/scala/chisel3/util/B
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摘要:https://mp.weixin.qq.com/s/80Q8j-OSMtgh5a92pI-MZA 使用value和mask来描述一个比特模式,即:value = bits & mask. 参考链接: https://github.com/freechipsproject/chisel3/blob/
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摘要:https://mp.weixin.qq.com/s/5oAwH3scumARzPidRBfG2w 带锁多入单出仲裁器,输出会被锁定指定的时钟周期。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src/main/scal
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摘要:https://mp.weixin.qq.com/s/GcNIFkHfa0gW0HKkKvHZEQ 循环优先级(Round Robin)仲裁器。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src/main/scala/
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摘要:https://mp.weixin.qq.com/s/7Y23gV6yPvtmvKHTo2I8mw 基于ReadyValid接口实现的多入单出仲裁器。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src/main/sca
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摘要:https://mp.weixin.qq.com/s/vlyOIsQxR6bCqDDMtRQLLg 实现队列模块,先入先出(FIFO)。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src/main/scala/chis
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摘要:https://mp.weixin.qq.com/s/g7Q9ChxHbAQGkbMmOymh-g ReadyValid通信接口。通信的双方为数据的生产者(Producer)和消费者(Consumer)。 通信协议: 1. Producer有数据要发送,则把Valid位置位为1; 2. Consum
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摘要:https://mp.weixin.qq.com/s/WeFesE8k0ORxlaNfLvDzgg 流水线,用于添加延迟。 参考链接: https://github.com/freechipsproject/chisel3/blob/master/src/main/scala/chisel3/uti
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摘要:https://mp.weixin.qq.com/s/L5eAwv--WzZdr-CfW2-XNA Chisel提供的Valid接口。如果valid为置1,则表明输出的bits有效;反之,则输出无效。 参考链接: https://github.com/freechipsproject/chisel3
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摘要:https://mp.weixin.qq.com/s/5lcMkenM2zTy-pYOXfRjyA 演示如何使用switch/is来实现状态机。 参考链接: https://github.com/ucb-bar/chisel-tutorial/blob/release/src/main/scala/
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摘要:https://mp.weixin.qq.com/s/tDpUe9yhwC-2c1VqisFzMw 演示如何使用状态机。 参考链接: https://github.com/ucb-bar/chisel-tutorial/blob/release/src/main/scala/solutions/Ve
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摘要:https://mp.weixin.qq.com/s/e8vJ8claauBtiuedxYYaJw 实现可以动态索引的表。 参考链接: https://github.com/ucb-bar/chisel-tutorial/blob/release/src/main/scala/examples/Tb
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摘要:https://mp.weixin.qq.com/s/-AVJD1IfvNIJhmZM40DemA 实现后入先出(last in, first out)的栈。 参考链接: https://github.com/ucb-bar/chisel-tutorial/blob/release/src/main
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