摘要：
一、系统总体架构 1.1 PS-PL异构分工 整个闭环优化系统基于Xilinx Zynq-7020 SoC的PS+PL异构架构： 层次 载体 职责 PL (FPGA) Artix-7逻辑资源 高速并行时序逻辑：ADC TDM数据解析、DAC SPI驱动、PSO算法硬件加速 PS (ARM) 双核Co 阅读全文
posted @ 2026-07-28 10:09
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摘要：
存储密度更大的随机存储器 1. 引言 在 ysyxSoC 项目中，我们先后引入了 SRAM（8KB） 和 PSRAM（4MB），但前者容量太小，后者访问带宽有限。为了运行大型程序（如 RT-Thread、microbench）并满足 CPU 对高带宽主存的需求，我们最终引入了 SDRAM（同步动态随 阅读全文
posted @ 2026-07-24 11:17
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摘要：
1. 项目概述 本系统是一个家电产线测试自动化平台，由三个组件协同工作： 组件 功能 启动方式 电压采集上位机 (1.py) 18通道 Modbus RTU 电压采集、波形显示、数据存储 独立启动 python 1.py NTC 模拟器 (NTC.py / NTCSimTab) 6通道 NTC 热敏 阅读全文
posted @ 2026-07-17 14:06
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该文被密码保护。 阅读全文
posted @ 2026-07-17 08:12
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UI 面板详细功能说明 本文档深入讲解各顶层视图下的子面板功能、控件、完整工作流、数据流、线程模型和实现细节。 一、DUT Test 视图 DUT Test 视图包含 4 个 Tab 页：Run Test、Product Management、TX Power Cal、RX Calibration。 阅读全文
posted @ 2026-07-17 08:11
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摘要：
Zynq AD7768 以太网数据传输升级方案 板卡: ACZ7015-CB (Zynq-7015) 目标: 将 AD7768 8通道 ADC 数据通过千兆以太网实时传输到 PC PC端: Python 接收程序 当前状态: 师兄的项目使用 UART (printf) 与 PC 通信，AD7768 阅读全文
posted @ 2026-07-17 08:11
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摘要：
1. 背景：为什么需要可重复编程的非易失存储器？ 1.1 MROM 的局限性 掩膜 ROM（MROM） 的内容在芯片流片时即固定，无法在芯片制造后修改。 成本高昂：重新流片更换程序需要数百万人民币的掩膜费用，周期长达 3~6 个月。 可编程性极弱：仅支持制造时编程，无法适应软件迭代和 bug 修复。 阅读全文
posted @ 2026-07-16 17:10
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摘要：
评审会议内容总览 日期： 2025年7月15日 评审场次： 电子元器件评审（14:19）/ 电控软硬件评审（16:31） 一、电子元器件评审（0715 14:19） 项目1：消毒柜变压器统一化变更 变更内容： 将消毒柜系列主板上的原立式变压器统一替换为7601主板所用的卧式变压器（编码135） 涉及 阅读全文
posted @ 2026-07-16 13:35
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摘要：
TDS三合一传感器集成研究项目 一、项目背景与整体架构 本项目为研究性项目，核心是将一颗集成TDS、浊度、温度三合一的传感器引入洗碗机产品，并在此基础上开发三大智能功能：智能漂洗、智能软水、智能排水（排空立停）。 硬件架构：一拖三 主控板软件需同时支持以下三路设备的通信： 设备 类型 备注 TDS三 阅读全文
posted @ 2026-07-16 11:19
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摘要：
内容涵盖了 SoC 集成、AM 运行时环境移植、链接脚本精髓、启动加载器实现以及 UART 驱动开发的完整链路。 ysyxSoC 核心开发链路小结 一、SoC 集成与总线架构 (Diplomacy) 核心工具：基于 Rocket-Chip 的 Diplomacy 框架，以 Chisel 语言实现。 阅读全文
posted @ 2026-07-13 16:56
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