随笔分类 - Verilog
Verilog language itself
摘要:执行顺序 该如何理解上面简单的几行字? 仿真器为了模拟硬件的并行执行,故意分为了一个一个time step,每个time step又是由一系列需要执行...
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摘要:================================================================================== ===================================begin=========================================== 以一下参考张德学的EDA课件: 挑些有用的,写写记心间 =...
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摘要:参考:Verilog HDL数字设计与综合(第二版) Samir Palnitkar Section 9.2 改写(覆盖)参数 传递的参数是子模块中定义的parameter。 传递的方法: 1、module_name #( parameter1, parameter2) inst_name( port_map); 2、module_name #( .parameter_n...
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摘要:Verilog code highlighter
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