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2021年7月24日
数码管显示字符
摘要: 参考资料(1)(42条消息) 数码管显示字母_老猫的博客-CSDN博客; (2)(42条消息) 8段数码管与字符对照表_蚂蚁取经-CSDN博客
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posted @ 2021-07-24 11:03 FPGA9161
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2021年7月23日
共阳型数码管字形码(二进制和十六进制)
摘要: 1. 共阳型数码管,数码管显示0-f对应的段选输出信号(二进制) 1 parameter NUM0 = 8'b1100_0000, 2 NUM1 = 8'b1111_1001, 3 NUM2 = 8'b1010_0100, 4 NUM3 = 8'b1011_0000, 5 NUM4 = 8'b100
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posted @ 2021-07-23 21:09 FPGA9161
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共阴型数码管字形码(二进制和十六进制)
摘要: 1. 共阴型数码管,数码管显示0-f对应的段选输出信号(二进制) parameter NUM0 = 8'b0011_1111, NUM1 = 8'b0000_0110, NUM2 = 8'b0101_1011, NUM3 = 8'b0100_1111, NUM4 = 8'b0110_0110, NU
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posted @ 2021-07-23 20:58 FPGA9161
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2021年7月21日
基于FPGA的呼吸灯设计
摘要: 1. 项目简介 呼吸灯,指的是一个LED从暗到亮,从亮到暗逐渐变化,如此循环反复,就像人的呼吸一样有节奏。它采用PWM的方式,在固定的频率下,通过调整占空比的方式来控制LED灯亮度的变化。 PWM(Pulse Width Modulation),即脉冲宽度调制,是一种对模拟信号电平进行数字编码的方法
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posted @ 2021-07-21 10:44 FPGA9161
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vivado广泛使用,ISE已过时?
摘要: 由于vivado的出现以及广泛使用,很多朋友都开始有这种想法:“Vivado使用这么广泛,ISE是不是已经过时了?”其实我觉得vivado和ISE并不是两个对立的开发工具,毕竟vivado和ISE都是xilinx家的。 vivado主要是面向7系列的高端FPGA进行开发,ISE主要是面向低端的FPG
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posted @ 2021-07-21 10:03 FPGA9161
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2021年7月19日
基于FPGA的4位二进制数除法器设计
摘要: 1. 设计要求: 设计一个4位二进制数除法器,如下图所示。其中,a[3:0]为被除数,b[3:0]为除数,s[3:0]为商,r[3:0]为余数。 2. 设计原理: 和十进制除法类似,以计算 27 除以 5 的过程为例:除法运算过程如下: (1) 取被除数的高几位数据,位宽和除数相同(实例中是 3bi
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posted @ 2021-07-19 21:31 FPGA9161
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2021年7月18日
基于FPGA的4位二进制数乘法器设计
摘要: 1. 设计要求: 设计一个4位二进制数乘法器,如下图所示。其中,a[3:0]为被乘数,b[3:0]为乘数,m[7:0]为积,即乘法结果。 注意:为什么乘法结果的有效位数要定义为8位?如:15x15=225。一般情况下,乘法结果的有效位数应为两个乘数位宽之和,从而保证得到正确的结果。 2. 设计原理
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posted @ 2021-07-18 19:57 FPGA9161
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