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verilog之function 1、基本作用 function，就是声明一个函数。与task的区别就是有参数。function的返回值就是函数名（可以设置位宽），输入值任意，均作为输入参数。代码块需符合verilog的语法规则。如放在assign块中的函数需要使用wire变量，always语句中的 阅读全文
posted @ 2020-08-08 14:51 绿叶落秋风 阅读(1849) 评论(0) 推荐(0) 编辑
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quartus的IP测试之LPM_DIVIDE 1、基本作用 一个用于除法的IP，可以输入除数、被除数，得到商、余值。 2、基本测试 `timescale 1ns/1ns module divide_tb; reg [7:0]denom; reg [7:0]numer; wire [7:0] quo 阅读全文
posted @ 2020-08-06 23:26 绿叶落秋风 阅读(2490) 评论(0) 推荐(0) 编辑
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quartus之LPM_COMPARE测试 1、IP描述 比较器的IP，可以比较两路数据是否相等。相等输出为1，不等输出为0的aeb信号是需要测试的量。 2、基础测试 module compare_top( input [7:0] x1, input [7:0] x2, output result 阅读全文
posted @ 2020-08-05 00:04 绿叶落秋风 阅读(955) 评论(0) 推荐(0) 编辑
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TCL基本语法2 1、format和scan 两个基本的函数，和C语言中的sprintf和scanf的作用基本相同。format将不同类型的数据压缩在字符串中，scan将字符串中的数据提取出来。 set name Jack set age 100 set worker [format "%s is 阅读全文
posted @ 2020-08-04 23:02 绿叶落秋风 阅读(525) 评论(0) 推荐(0) 编辑
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TCL之基本语法1 1:set and puts set就是变量声明，这个声明在需要使用的指令下会自动执行，不会出现没有声明的错误。但是对于puts这类定向访问的是不能没有声明的。这里简单理解TCL中的变量：以字符串的形式存在，具体的值由$符号访问。访问之前必须已经有声明。 set x 0 puts 阅读全文
posted @ 2020-08-03 10:56 绿叶落秋风 阅读(886) 评论(0) 推荐(0) 编辑
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zynq之TF卡写入函数f_printf 1、基本原理 前面使用f_write写入了数据到TF（SD）卡中，可以实现较短字符串的写入。当字符增加时，容易出现乱码。而f_printf则是专门用于字符串写入的函数，支持整型和字符型数据的写入，可以提高数据写入的灵活性和便捷性。 2、实验操作 要使用f_p 阅读全文
posted @ 2020-07-31 22:09 绿叶落秋风 阅读(1317) 评论(0) 推荐(0) 编辑
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quartus之rom的IP测试 1、rom的作用 rom，就是只读存储器，内部数据在下载电路时就已经确认，不能使用信号驱动更改，只能够读取，一般用于比较重要的配置数据。在quartus中，可以直接调用IP核实现该操作。配置文件有hex和mif两种，都可以实现数据的写入。 2、测试方法 测试代码： 阅读全文
posted @ 2020-07-30 22:03 绿叶落秋风 阅读(752) 评论(0) 推荐(0) 编辑
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verilog之预编译 1、基本作用 预编译，就是在verilog进入编译器前的准备工作。一般是完成一些文件的调用，一些编译器的设置，一些参数的定义。一般使用include，define，timescale就可以实现。比较灵活的使用是ifdef和endif的插入，可以将预编译的功能拓展。 2、使用事 阅读全文
posted @ 2020-07-30 20:34 绿叶落秋风 阅读(938) 评论(0) 推荐(0) 编辑
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zynq之TF卡写入常见问题 1、基本原理 前面做过zynq的TF读写实验，使用串口返回了实验所需的现象。那个时候也没有深究头文件"ff.h"里的几个常用的函数。这次需要使用TF卡做实验时发现很多操作都不大一样，不能够简单的重复，这里把几个常见的问题列举出来，方便以后的查阅。 2、实际问题 先用一段 阅读全文
posted @ 2020-07-29 23:10 绿叶落秋风 阅读(1072) 评论(0) 推荐(0) 编辑