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摘要： 0. 引言 在UVM支持的寄存器操作中，有get、update、mirror、write等等一些方法，在这里整理一下他们的用法。 寄存器模型中的寄存器值应该与DUT保持同步，但是由于DUT的值是实时更新的，所以寄存器模型并不能实时知道这种更新，在寄存器模型中专门有个值来尽可能与DUT中寄存器的值保持 阅读全文

摘要： 1. AHB仲裁器信号： 2. 仲裁过程包括四个基本步骤： 1．主设备使用HBuSREQx信号请求访问总线； 2．仲裁器置位相应的HGRATx信号，表示主设备的申请已成功，它将在当前传输完成时获得总线访问权； 3．主设备拥有地址／控制总线； 4．主设备拥有数据总线。 3. 请求总线访问 1. mas 阅读全文

摘要： 说明： 之前买了个网上的教学《深入浅出计算机组成原理》，正好有一篇讲Cache的文章。从网站上没法直接复制，截了点图放在这里了。 讲的云里雾里，不好。 在CSDN中找到一个：https://blog.csdn.net/dark5669/article/details/53895744#comment 阅读全文

摘要： 说明： 这篇文章挺好，转载一下，防止迷路。 转载： https://my.oschina.net/fileoptions/blog/1630855 Cache的容量很小，它保存的内容只是主存内容的一个子集，且Cache与主存的数据交换是以块为单位的。为了把信息放到Cache中，必须应用某种函数把主存 阅读全文

摘要： 说明： 本文是从一个微信公众号上复制过来的，链接：https://mp.weixin.qq.com/s?__biz=MzIyMjYxNzA4NQ==&mid=2247484965&idx=1&sn=af7e8303c0ecac530067f02244734fe1&chksm=e82b8ab7df5c 阅读全文

摘要： 去中兴面试的时候被问到vcs 的使用方式，现在整理一下。 1. three-step flow 第一步：analysis——vlogan、vhdlan 在analysis　phase中VCS会检查文件的语法错误，并将文件生成elaboration phase需要的中间文件，将这些中间文件保存在默认的 阅读全文

摘要： 在前几天的ARM面试中，被问到总线架构，主要是AMBA那一套东西。对于AMBA之前上课学过一点，但很肤浅。为了面试上网查了一下、也看了部分协议补充了一下，但是接触的少，理解的不深入，被问到之前没遇到的东西，就被难住了。问了我slave有哪两种HREADY信号，每个都有什么用，HREADY复位之后是高 阅读全文

摘要： 本文参考： 1. https://www.cnblogs.com/lkiller/p/4773235.html 2. AMBAAXI and ACE ProtocolSpecification 0.绪论 AXI是高级扩展接口，在AMBA3.0中提出，AMBA4.0将其修改升级为AXI4.0。AMBA 阅读全文

摘要： 之前去地平线面试的时候被问到了multicycle path的一点问题，其实这个问题我应该知道，看过《Constraining Designs for Synthesis and Timing Analysis A Practical Guide to Synopsys Design Constra 阅读全文

摘要： 0. 介绍 跨时钟域传递的方法，Cummings的论文（见附录）中讲的很详细，之前自己也详细看过，除了他的论文还从网上看了一些其他人讲的关于跨时钟域的东西，以为自己已经掌握了跨时钟域的基本方法，面试、笔试完全不虚了，但是呢，前几天去某AI芯片公司二面，在跨时钟域问题上露怯，当然，面试过程全程被吊打， 阅读全文