随笔分类 - 杂谈
个人的见解和看法
摘要:卡诺图 卡诺图(Karnaugh map)是真值表的变形,它可以将有n个变量的逻辑函数的2n个最小项组织在给定的长方形表格中,同时为相邻最小项(相邻与项)运用邻接律化简提供了直观的图形工具 在数字电路中,对逻辑值的化简常常要用到卡诺图,而卡诺图的化简也常常困扰初学者 官方的化简办法 选自维基百科(卡
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摘要:大致的说: 自底向上而言,计算机的结构应该是: 按规则组织的物理元器件 -> 按规则(指令集)进行控制物理元器件 -> 任务复杂程度高,数量多,资源利用率低,使用规则(指令集)设计出监控程序(操作系统)管理任务 -> 为解决任务复杂,指令集过多,设计出解释程序(编译器)将高级语言转化为指令集 ->
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摘要:一步到位 github仓库 这个超级好用,挺简单的说QwQ 该仓库有详细的博客搭建主题,可以跟着教程走 ~~其实也就是把对应的CSS和JS代码复制过来~~ 增加其他的特效和动画 看板娘 各种动态特效 个人博客搭建 其余方式: github+hexo:需要在自己的电脑上部署相应的环境,比较麻烦 服务器
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摘要:引言 因为一些额外的步骤,更改了cmdline.txt中的内容,后面树莓派就不能正常启动 参考的资料: 官方的文档 默认的配置 翻译得很烂的中文文档 cmdline参数介绍 正题 对于这个cmdline.txt文件,主要的作用就是在操作系统启动时传递参数给操作系统,从而配置一些选项,比如:把信息通过
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摘要:引言 在学习FPGA时,在野火的课程中学习到了关于分频和降频两个有点相似的东西,在此记录 下列所有图片均来自于野火图书 点击访问野火图书 分频 百度百科: 分频器是指使输出信号频率为输入信号频率整数分之一的电子电路。对于任何一个N次分频器,在输入信号不变的情况下,输出信号可以有2pi/N的相位。这种
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摘要:引言 在CPU流水线中会出现一些相关的情况,导致流水线不能很好地表现出理论性能 流水线相关分类 结构相关 指的是在指令执行过程中,由于硬件资源满足不了指令执行的要求,发生硬件资源冲突而产生的相关 例子:指令和数据使用同一个存储器,如果取指的同时需要对存储器中的数据进行访问,产生存储器访问冲突 控制相
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摘要:引言 该文章不适用于Verilog入学 Verilog标准手册下载地址: Verilog标准手册 简介 基本元件模块:逻辑门和用户定义的原语模块(UDPs) NET:表示电路连线或是总线的网络 寄存器:可以作为输入信号连接到某个具体模块的输入口 模块中每个initial,always,连续赋值ass
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摘要:引言 最近欢天喜地的买了一台显示器,(我终于可以多屏协作了QwQ 但是,好几次都遇到这样的问题,我连接上显示器后,我的独显不见了QAQ,以至于扩展的显示屏毫无反应 笨重的解决办法 直接重装,驱动什么的也都重新装一遍,耗时长,而且,很麻烦,资料什么的还要备份一下,软件的路径也要自己去添加QAQ 尝试后
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摘要:编译时错误 语法错误,容易解决,初学时及其容易遇到; 一般遇到该问题的时候,应该认真阅读代码,以及合理利用搜索引擎 运行时错误 不容易遇到,但是一遇到就需要调试很久~ 需要检查数组越界,以及递归函数的使用等等。 逻辑错误和语义错误 程序可以正常运行,但是没有达到预期的目标 原因: 采用了错误的算法,
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摘要:引言 之所以写这个是因为自己学了一些知识之后,不能很好的处理他们,总是会陷入细节中而忽视了自己的目标,要么就是会陷入迷茫,这个是用来做什么的,特此整理。 正题 我眼中的体系结构: 第零层 基础物理元件 第一层 门电路 第二层 组合逻辑电路+时序逻辑电路 第三层 基础元件:ALU,移位器,译码器 第四
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摘要:在十进制转换为其他进制中,每次都得到较低位 思考: 每次操作时,可以作为一次模运算 而每次对十进制数模运算时,都可以得到十进制数的较低位的值!
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