随笔分类 - FPGA design
摘要:因为模块的交接,最好将写好的源文件和生成的IP封装一个IP,然后再转交给其他的同事使用,这是一种好的习惯。但是对于,封装的过程还是需要注意一下。实际的看看步骤吧。1)将源文件和使用到的IP生成工程. 2)在tools->create and package IP 打开入下图 3)注意选项,和生成的文
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摘要:http://www.george-smart.co.uk/wiki/Xilinx_JTAG_Linux
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摘要:这几天在写驱动加密芯片的代码产生了一个典型的错误:代码如下 这段代码的本意是在rst_strt有效时,给出一个复位标志;在复位结束时,清零复位标志。但是使用上述代码是有优先级的,即需要rst_strt先无效,之后才能响应end_rst。实际中没有考虑到rst_strt及时的清除。
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摘要:multiboot的功能对于不同的FPGA应该是相同的,但是具体的配置可能不一样。基本流程如下: 上图来源是xapp1246, 明显分为5个步骤,在FPGA启动时是有flash的0地址开始,但是因为golden image加了一些配置,在FPGA接收到这些配置是会转到其他的地址,继续读update
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摘要:在FPGA中,有时需要使用用户代码重配置FPGA,配置的内容可以是flash或者是其他的来源这样FPGA的启动模式有关,在本实验中配置文件是存放在flash中。实际的操作步骤如下: 1:生成一个工程,工程的内容是led灯在闪烁。并且生成相应的mcs文件,通过jtag烧录到板卡上的 bpi flash
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摘要:目前,大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计,对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求,一般在FPGA设计中采用全局时钟资源驱动设计的主时钟,以达到最低的时钟抖动和延迟。 FPGA 全局时钟资源一般使用全铜层工艺实现,并设计了专用时钟缓冲...
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摘要:sram的型号:ISSI IS61LV25616 -10TL以上是数据手册上的。对sram的认识:SRAM不需要刷新电路即能保存它内部存储的数据。而DRAM(Dynamic Random Access Memory)每隔一段时间,要刷新充电一次,否则内部的数据即会消失,因此SRAM具有较高的性能,但...
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摘要:这里记录一个实际的需要使用乒乓操作的例子:读sd卡数据的时,在spi的模式下。发送单数据块的读取命令,在回应之后会有512字节的数据。使用乒乓操作,可以用两个八位的寄存器,就可以完成连续的512字节读入fifo。但是如果操作不好的话就会出现位置不对的情况。上图是读入fifo的数据。上图是实际的数据。...
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摘要:这里不讨论异步fifo是如何实现的,而是在实现fifo的前提下,对fifo的读写。现在遇到的问题是:总线的数据不能写入fifo中,但是地址能加一。代码如下: if( !fifo_tx_full && cpu_write_fifo_en ) begin fifo_r[ write_a...
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