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9-【友晶科技Terasic】基于FPGA实现LTC2308控制器的设计——自定义IP设计步骤(Avalon MM)（17.1） Doreen的FPGA自留地 2025-02-21 11:49 阅读:301 评论:0 推荐:0

8-【友晶科技Terasic】基于FPGA实现LTC2308控制器的设计——Quartus工程创建（17.1） Doreen的FPGA自留地 2025-02-21 10:40 阅读:346 评论:0 推荐:0

5-【友晶科技Terasic】基于FPGA实现LTC2308控制器的设计——自定义IP的寄存器读写控制和FIFO读写控制 Doreen的FPGA自留地 2025-02-14 16:24 阅读:297 评论:0 推荐:0

【友晶科技Terasic】自定义组件的命名和教程一样，为什么最后在qsys里面产生的信号名称不一样？nios2_system_inst.v Doreen的FPGA自留地 2022-04-18 12:29 阅读:53 评论:0 推荐:0

【友晶科技Terasic 】RAM IP调用及单口RAM的控制实现 Doreen的FPGA自留地 2022-03-18 16:03 阅读:496 评论:0 推荐:0

【友晶科技Terasic】解读Nios II IP 的 Reset Vector 和 Exception Vector Doreen的FPGA自留地 2021-10-27 14:55 阅读:1064 评论:0 推荐:0

【教程】了解FPGA远程教学实验平台！数字逻辑、计算机组成、嵌入式设计、AI人工智能 Doreen的FPGA自留地 2021-10-18 17:20 阅读:1006 评论:2 推荐:0

【友晶科技Terasic】Avalon-MM slave 为什么 readdata 要在第二个时钟周期才有数据？ Doreen的FPGA自留地 2021-09-22 16:22 阅读:138 评论:0 推荐:0

自定义IP之 ——为什么.tcl文件拷贝到ip目录下后打不开该IP Doreen的FPGA自留地 2021-01-29 17:45 阅读:251 评论:0 推荐:0

自定义IP 之—— Avalon总线对寄存器的读写 Doreen的FPGA自留地 2021-01-29 17:14 阅读:271 评论:0 推荐:0

自定义IP之——Avalon MM slave 接口的IP 读数据（readdata）的控制信号read_n是必须的吗？ Doreen的FPGA自留地 2021-01-29 15:14 阅读:456 评论:0 推荐:0

Quartus 自定义一个IP核，通过AXI总线被HPS系统控制（未完待续） Doreen的FPGA自留地 2021-01-28 15:13 阅读:330 评论:0 推荐:0