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zwh搁浅
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Verilog设计
FPGA跨时钟域处理的方法总结
摘要:在实际应用的工程中,绝大部分使用的是多时钟系统,在多时钟系统中进行数据传输,不可避免的就会遇到跨时钟域的情况。而对于跨时钟域处理的信号,如果处理不当就会出现亚稳态,导致系统无法正确运行。以下是个人总结的几个对跨时钟域处理的同步方式总结: 1.双触发器同步器 使用双触发器来进行同步是最常用的同步方式(
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2021-09-30 10:14
zwh搁浅
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