随笔分类 -  Verilog

摘要:1 // 2 // Verilog Module demo1_lib.bus_arbitor.arch_name 3 // 4 // Created: 5 // by - Newhand 6 // in - Shanghai ZhangJiang 7 // at - 20:39:41 2003-12-03 8 // using Mentor Graphics HDL Designer(TM) 9 // 10 /////////////////////////////////////////////////////////... 阅读全文
posted @ 2012-01-16 14:55 宫藏嘉辈 阅读(5320) 评论(1) 推荐(0)
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posted @ 2012-01-16 14:34 宫藏嘉辈 阅读(384) 评论(0) 推荐(0)
摘要:良好代码编写风格可以满足信、达、雅的要求。在满足功能和性能目标的前提下,增强代码的可读性、可移植性,首要的工作是在项目开发之前为整个设计团队建立一个命名约定和缩略语清单,以文档的形式记录下来,并要求每位设计人员在代码编写过程中都要严格遵守。良好代码编写风格的通则概括如下:(1) 对所有的信号名、变量名和端口名都用小写,这样做是为了和业界的习惯保持一致;对常量名和用户定义的类型用大写;(确实如此,企业中的主流规范皆是如此。)(2) 使用有意义的信号名、端口名、函数名和参数名;(3) 信号名长度不要太长;(但是也要尽可能一看就知道含义。)(4) 对于时钟信号使用clk 作为信号名,如果设计中存在多 阅读全文
posted @ 2012-01-04 14:10 宫藏嘉辈 阅读(5013) 评论(0) 推荐(1)