VHDL模板
摘要:        
摘自alter在线视频的ppt常量-命名相关值-常量声明 CONSTANT <name> : <DATA_TYPE> := <value>; CONSTANT bus_width : INTEGER := 16;-执行代码不能改变它-提高代码的可读性-提高代码的灵活性信号-表示物理互联(线)的信号,实现进程之间的通信(函数)-信号可以在封装,实体和体系结构中进行声明为信号赋值SIGNAL temp : STD_LOGIC_VECTOR (7 DOWNTO 0);-所有比特: temp <= "10101010"; temp <    阅读全文
        
        
            posted @ 2012-05-14 13:27
zhliao
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         浙公网安备 33010602011771号
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