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2021年11月20日
【P5】Verilog搭建流水线MIPS-CPU
摘要: 课下 Thinking_Log 1.为何不允许直接转发功能部件的输出 直接转发会使一些组合逻辑部件增加新的长短不一的操作延迟,不利于计算设置流水线是时钟频率(保证流水线吞吐量?)。 2.jal中将NPC+4/8存入$ra的操作为何需流过全级 不要因为beq指令提前得到结果完成跳转的事情乱了方寸。ja
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posted @ 2021-11-20 00:10 Xlucidator
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2021年11月15日
【小鼓捣】手搓Verilog-CPU测试全流程自动化
摘要: 自动化流程思路 1.C++/Python:生成大量包含指定指令的mips程序(A.asm) 2.命令行:导出该mips程序指令的机器码(A.txt) 3.魔改MARS:产生测试所需的IM、DM存入信息 4.命令行:导出该mips程序在魔改MARS运行产生的测试所需信息(B.txt) 5.Verilo
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posted @ 2021-11-15 23:30 Xlucidator
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2021年11月14日
【P4】Verilog搭建单周期MIPS-CPU
摘要: 课下 Bug_Log 1.模块实例化的信号需先定义,且记得定义完备 其实testbench见过多次了,自己写的时候还想不清。 若实例化模块时使用的信号,若事先无声明,则会自动生成1bit此名称信号,自然在多位信号传输中便出错了。使用单位信号的模块到可以省略实现声明。 !由于mips.v的clk和re
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posted @ 2021-11-14 23:33 Xlucidator
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2021年11月12日
【P3】Logisim搭建单周期MIPS-CPU
摘要: 最近在想,我究竟能从计组课程中学到什么。依葫芦画瓢地搭一个CPU不难,但稍微设想一下从无到有设计指令,构建数据通路控制器,再到优化为多周期、流水线,在权衡中各模块互相调节...整个过程复杂困难曲折到令人咋舌。(就比如流水线CPU的构想,要是我来设计,遇到数据冒险的问题后,估计直接放弃方案了) 搭建之
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posted @ 2021-11-12 22:34 Xlucidator
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2021年11月4日
【P2】MARS使用/MIPS汇编
摘要: 课上 T1 在n位数中删除N个数使剩下的(n-N)位数最大 写得似乎过于谨慎而慢了,没出现寄存器打错的问题,一遍过了 T2 拆分数字 将输入整数N拆分为几个数相加的形式,按拆分项数降序排列,每项按数字大小升序排列(giao记不清了) 输入 5 输出 1+1+1+1+1 1+1+1+2 1+1+3 1
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posted @ 2021-11-04 12:55 Xlucidator
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2021年11月2日
【练习回顾】dfs迷宫+路径打印
摘要: 很直接的dfs。递归+栈——不知道以后会不会生疏 进入一次dfs,相当于走一步,入栈;结束一次dfs,相当于这一步考虑结束,出栈 笑死,y1竟然是一个函数 突然发现写的有点槽,可以把dfs形式化为“走一格”,map的填充可以放在dfs的首尾,而不用在每个if里写一遍。有空再改一下。 题目描述 输入一
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posted @ 2021-11-02 00:33 Xlucidator
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2021年10月31日
【练习回顾】再看全排列
摘要: 递归 递归直接翻译自我们自己书写全排列时的思路。 \(A_{n}^{n}\) 即为从第1位起到第n位中,每一位均按升序将排列内容遍历。 \[ \begin{align*} A_{n}^{n} & = n \cdot A_{n-1}^{n-1} \\ & = n \cdot (n-1) A_{n-2}
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posted @ 2021-10-31 14:28 Xlucidator
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2021年10月30日
【MIPS】P2课下零碎
摘要: 1..word使用 .word 0:63 并非划出了64个 4Byte 地址,而是63个,可从编译后Label窗口中查看 2.syscall读取字符 li $v0, 12 syscall 此时\n也会被读入,需考虑类似C中%c的处理手法。 输入时连续输入内容不加回车,或者每次读取调用两次syscal
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posted @ 2021-10-30 20:21 Xlucidator
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【SfM】Colmap和openMVG尝试记录
摘要: 数据集来源:http://www.maths.lth.se/matematiklth/personal/calle/dataset/dataset.html Colmap与openMVG关于SfM稀疏重建对比 1.NikolaiI 图片数:98 重建方式:sequential Colmap GUI
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posted @ 2021-10-30 09:55 Xlucidator
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2021年10月28日
【P1】Verilog部件级实验/有限状态机
摘要: 课上 再次体验大心脏 T1 奇偶校验 for循环数1的个数判断奇偶/异或缩减运算符判断奇偶,然后根据check的奇偶要求调整最高位 bug1 !注意优先级:位运算 低于 比较运算。 cnt & 1 == 0 //恒为0 (cnt & 1) == 0 //cnt偶数时为1 属于是灯下黑了,调试了半天人
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posted @ 2021-10-28 12:24 Xlucidator
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