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2023年1月23日
新手IC617安装NCSU pdk
摘要: 新手IC617安装NCSU cdk 以CMOSedu网站为参考:https://cmosedu.com/videos/cadence/tutorial1/cadence_tutorial_1.htm pdf教程下载:https://files.cnblogs.com/files/wyjalx/%E6
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posted @ 2023-01-23 17:24 小龙别哭
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2022年3月6日
pads:数据格式不正确,网络必须包含一个以上管脚
摘要: 1,如果已经有pcb封装,则在pads logic软件里面—元件编辑器—重新做封装,在——编辑电参数——里面匹配对应pcb封装, 2,点击—工具——,——从库中更新——,更新一下,之后导入pcb layer 的报告就不会有这个问题了。
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posted @ 2022-03-06 19:35 小龙别哭
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2020年10月31日
zynq 中断
摘要: #include "stdio.h"#include "xparameters.h"#include "xgpiops.h"#include "xscugic.h"#include "sleep.h" //ps_led#define MIO15_LED 15 #define MIO47_KEY 47
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posted @ 2020-10-31 21:17 小龙别哭
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2020年10月29日
zynq_ps端点亮led灯代码
摘要: #include "stdio.h"#include "xparameters.h"#include "xgpiops.h"#include "sleep.h" //ps_led#define MIO15_LED 15#define GPIO_DEVICE_ID XPAR_XGPIOPS_0_DEV
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posted @ 2020-10-29 19:39 小龙别哭
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2020年8月2日
modesim : mosel not define
摘要: 这个星期仿真sdram时,添加的sdram 模型文件在modesim中总是找不到,在qq群里提问和私聊别人都没有得到解决方法。于是自己摸索了好多天。终于得到了解决。 可以看到modesim里面work没有我们的sdr文件: 接下来我们点击modesim里面compile compile....; 然
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posted @ 2020-08-02 09:11 小龙别哭
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2020年7月30日
quartus报错 Error (10054): Verilog HDL File I/O error at sdram_ctrl_tb.v(6): can't open Verilog Design File "Sdram_params.h"
摘要: 解决方法:包含完整路径。 比如我一开始是:`include "Sdram_params.h" 错误(改为:`include "F:\FPGA\exce\uart2sdram2vga\rtl\Sdram_params.h"就ok了。) 修改:`include "../rtl/Sdram_params.
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posted @ 2020-07-30 16:11 小龙别哭
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2020年7月27日
解决nios eclipse报错: WARNING: Couldn't compute FAST_CWD pointer的方法
摘要: 几天照着书上的例子弄nios的开发流程,编译的时候遇见了这个问题 WARNING: Couldn't compute FAST_CWD pointer 在网上找了大半天解决方法,如下: 链接:https://pan.baidu.com/s/16o7MFrVcUFMi5r8MPZ7zSQ 提取码:65
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posted @ 2020-07-27 15:41 小龙别哭
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2020年7月19日
fpga 通过vga模块使电脑显示图片
摘要: 对vga模块搞了好几天,vga接口时序不难,就是行计数,列计数,对应到每一个像素上去。这里我先把vga控制模块的程序付上。采用的是小梅哥的程序。屏幕是800X600,配置的时钟是40M.注意改变屏幕尺寸时记得重新配置pll.我就是拿着小梅哥的例子直接用,结果屏幕显示输入信号超出范围。 /* ** L
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posted @ 2020-07-19 23:15 小龙别哭
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2020年7月4日
FPGA串口 波特率的计数器值
摘要: 开发板时钟为50Mhz, t为 20ns; xxx波特率时指每秒传xxx bit字节数据.也就是T=1/xxx; 再用T/t就可以得出波特率的计数周期了; 例如9600:T=1/96000=1.041666666666667e-4;T/t=5208.333...,取整5208 下面是不同波特率之间的
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posted @ 2020-07-04 17:36 小龙别哭
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2020年5月29日
verilog 进制的表示
摘要: n'b 是二进制 n’h 是十六进制 n‘d 是四进制 n是位数
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posted @ 2020-05-29 11:13 小龙别哭
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