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若狭
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2020年9月26日
fpga中基于vivado的verilog语言——ov5640的上电时序编写
摘要: 首先必查ov5640的datasheet。得知他的上电时序图 主要要注意的信号主要有三个。前三个信号,dvdd,d0vdd,avdd都是直接由摄像头内部配置好的,所以不用管。需要注意的是pwdn和resetb两个信号。 需要我们去规划的时间段有三个t2和t3和t4。 值得一说的是本人采用always
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posted @ 2020-09-26 14:04 若狭
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2020年9月13日
基于fpga的vga驱动基础-条纹显示----xilinx-vivado-verilog
摘要: 虽然现在通常可以直接调用ip核,但在学习过程中还是应从原理出发。本人也是第一次学习fpga。 主要来说vga驱动主要还是两个部分。 1.计数器部分。 这部分主要是对过程起计数作用。以确定现在现在处于一个传输过程的哪个阶段。 2.数据传输部分 这部分主要是运用计数器部分来确定输入数据(即像素点)是在哪
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posted @ 2020-09-13 21:05 若狭
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