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2018年1月4日

摘要： 1. set_input_delay和set_output_delay的选项-max和-min的理解首先 input/output其实是模拟数据在端口外的延时，是一个外部约束条件，目的是为了约束FPGA输入端口到内部寄存器数据输入端或者内部寄存器输出端到FPGA输出端口之间允许的延时。计算max时阅读全文

posted @ 2018-01-04 18:17 itman555 阅读(1802) 评论(0) 推荐(0)

2017年12月31日

2017年终于过去了...

摘要： 2017年，该说bye-bye了,今天是2017年最后一天了，终于申请了微博,这也是一个新的开始，期望新的一年，2018年，勇于拼搏，锐意进取，收获满满来期待... 阅读全文

posted @ 2017-12-31 18:47 itman555 阅读(80) 评论(0) 推荐(0)