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2016年12月22日
转: ZigBee/Z-Stack CC2530实现低功耗运行的配置简介
摘要: 转: ZigBee/Z-Stack CC2530实现低功耗运行的配置简介http://bbs.elecfans.com/jishu_914377_1_1.html(出处: 中国电子技术论坛) 设备支持低功耗运行是ZigBee网络的一大特点,该特性借助CC2530芯片能够很好地体现出来。CC2530芯
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posted @ 2016-12-22 13:04 深水无声
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2016年12月21日
三种zigbee网络架构详解
摘要: 在万物互联的背景下,zigbee网络应用越加广泛,zigbee技术具有强大的组网能力,可以形成星型、树型和网状网,三种zigbee网络结构各有优势,可以根据实际项目需要来选择合适的zigbee网络结构。 zigbee作为一种短距离、低功耗、低数据传输速率的无线网络技术,它是介于无线标记技术和蓝牙之间
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posted @ 2016-12-21 09:52 深水无声
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2016年8月13日
adc verilog spi 时序
摘要: 我用的是adc081sd芯片,(由于我们使用的是FPGA不用像单片机那样考虑极性cpol,相位cpha,下面仅仅介绍下跟单片机比较下) 什么是cpol:若cs被拉为低电平时sclk(时钟)是高那么cpol为1,若cs被拉为低电平时sclk为0时,cpol为0; 什么是相位 cpha:若cs被拉为低电
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posted @ 2016-08-13 11:41 深水无声
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dac verilog ad5601
摘要: 首先从官网下载数据手册。DAC有串行有并行,ad5601是串行,(需要好多时钟沿的移位内部转换为并行在输出)。 按照手册的时序编写程序, 关注下芯片的波特率范围 看看手册的数据传输那些事有效的数据位 module dac(input clk,input rst_n_in,output reg scl
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posted @ 2016-08-13 11:28 深水无声
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2016年8月6日
verilog 三段式状态机的技巧
摘要: 三段式代码多,但是有时钟同步,延时少,组合逻辑跟时序逻辑分开并行出错少。 (1)同步状态转移 (2)当前状态判断接下来的状态 (3)动作输出 如果程序复杂可以不止三个always 。always 后常接case case必须有default ,对于FPGA常用 状态数较少,独热码编码 ,或者格雷码
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posted @ 2016-08-06 10:29 深水无声
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2016年7月7日
fpga 状态机 检测1011序列
摘要: 1011 可以使用4个状态:s0,s1,s2,s3. 即:(1)s0有0或1两个状态,当s0位0时,进入s0状态,自身打圈。为1那么进入下个状态s1来检测0。 (2)s1有0或1两种情况,s1为1时s0,s1:1,1.此时的s1是1可以作为下次的1011的第一个1,有用的信号。再检测下一步是否0进入
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posted @ 2016-07-07 21:05 深水无声
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lattice diamond fpga 状态机的理解
摘要: 比如序列检测101,需要三个状态 :so,s1,s2。 思路:(1)s0状态有两种情况0或1,若为0时在自身打圈,是1时进入s1状态。 (2)s1状态有两种0或1,若为1自身打圈,因为1可以作为下次检测101的起始,有用信号,相当于s0自动进入s1所以自身打圈。若是s1是0则进入下个状态s2,。 (
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posted @ 2016-07-07 20:30 深水无声
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fpga Verilog hdl 按键消抖 部分程序讲解
摘要: module debounce(clk_in,rst_in,key_in,key_pulse,key_state); input clk_in;//system clock input rst_in;//system reset input key_in;//button input output
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posted @ 2016-07-07 20:01 深水无声
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