摘要：
要想了解caffe生成的caffemodel文件里的内容，我们就需要解析.caffemodel文件（caffemodel里不仅存储了权重和偏置等信息，还存储了整个训练网络的结构信息，即.prototxt信息，当然solver.prototxt信息是看不见的）。1.单独查看要是只是想看看权重信息正不正 阅读全文
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重装了python3.6.7，运行Django项目时报错：ModuleNotFoundError: No module named '_sqlite3'，百度搜索解决方案，是缺少sqlite3模块，搜索了几个方案，找到一个能用的记录下来。1，下载源码编译安装sudo wget https://www 阅读全文
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在上一篇博文中，写了关于怎么解决ERROR 1045 (28000): Access denied for user 'root'@'localhost' (using password: YES问题的暂时解决方法，当时是弄了很久没有弄出来，所以没有先暂时跳过密码验证完成了了数据库的查询，今天来说说 阅读全文
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可以用快捷方式来实现,在快捷方式的高级选项里有 "以管理员身份运行" 选项. 阅读全文
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问题： m.click(1, 1, 1, 2) 用Python模拟鼠标单击左键，用了很多种方法，但是都出现同样的问题。 程序本身没有错误，运行时，如果目标点是 桌面上的一个图标，那么可以成功点击；但是如果是一个程序窗口，只会光标移到到目标点，无法实现点击。奇怪的是，我试了如果目标点是chrome浏览 阅读全文
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-- 1）实体部分 //verilog module AD9517_Cfg ( i_9517cfg_CfgClk , // 数据时钟 i_9517cfg_CfgClk180 , // 配置时钟，与数据时钟反向180度 i_9517cfg_Arst_n , // 全局复位 o_9517cfg_SpiC 阅读全文
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前言：ZYNQ 7000有三种GPIO：MIO，EMIO，AXI_GPIOMIO是固定管脚的，属于PS，使用时不消耗PL资源；EMIO通过PL扩展，使用时需要分配管脚，使用时消耗PL管脚资源；AXI_GPIO是封装好的IP核，PS通过M_AXI_GPIO接口控制PL部分实现IO，使用时消耗管脚资源和 阅读全文
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九州生气持风雷,万马齐吟究的哀.我劝天公重抖擞，不拘一格降人才。 龚自珍 阅读全文
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FPGA学习——Xilinx Vivado 实现led流水灯详解整个流程 创建工程 设计代码、编写功能 RTL分析——引脚定义和绑定 综合synthesis 时序约束 仿真设置并配置激励文件(中小等项目可跳过，直接在线调试毕竟仿真时间太久) 生成bit文件导入fpga中——在线调试 判断是否达成目标 阅读全文
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[root@gaojingbo yum.repos.d]# wget https://gcc.gnu.org/gcc-7/ --2018-08-16 17:08:54-- https://gcc.gnu.org/gcc-7/ Resolving gcc.gnu.org (gcc.gnu.org).. 阅读全文
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1 生成ssh key，使用默认保存位置（注意要求输入密码时直接回车，否则每次要输密码）[root@localhost ~]# ssh-keygen -t rsaGenerating public/private rsa key pair.Enter file in which to save th 阅读全文
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This problem occurred to me especially behind corporate firewall after updating ubuntu to 18.04 LTS. I tried all possible approaches before coming acr 阅读全文
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阿里云服务器共享型S6/计算型C5/通用型g5这三款相同点是： I/O优化实例，支持ESSD云盘、SSD云盘和高效云盘不同点看下面详细描述。共享型S6、计算型C5、通用型g5不同点1、共享型s6可用范围还是很广泛的，相比上一代共享型实例性能提升。需要更高性能，更换SSD云盘就行。共享型s6适合轻量级 阅读全文
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