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2022年12月6日
基于Xilinx FPGA的以太网接口的链接状态获取方法
摘要: 链接状态:pg138-axi-ethernet.pdf 《AXI 1G/2.5G Ethernet Subsystem v7.2》Figure 2-38: PCS PMA TEMAC Status Register (0x0000_0030)比特位:PhyLinkStatuspg051-tri-mo
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posted @ 2022-12-06 10:09 zcarl
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2022年11月23日
HDLBits-Adder3问题
摘要: 知识点 genvar i; generate for(i = 0; i < 3 ; i = i + 1 ) begin:fadd_arr fadd fadd_inst(a[i], b[i], i==0?cin:cout[i-1], cout[i], sum[i]); end endgenerate
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posted @ 2022-11-23 23:14 zcarl
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2022年11月21日
HDLBits-Mux9to1v问题
摘要: 知识点 always @(*) case(sel) 2'b00: begin sout_t = p0 ; end 2'b01: sout_t = p1 ; 2'b10: sout_t = p2 ; default: sout_t = p3 ; endcase 第一次 回答 module top_mo
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posted @ 2022-11-21 22:56 zcarl
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2022年11月20日
HDLBits-Mt2015_q4问题
摘要: 知识点 无 第一次 回答 module top_module (input x, input y, output z); wire az1,az2,bz1,bz2; A IA1( .x(x), .y(y), .z(az1) ); A IA2( .x(x), .y(y), .z(az2) ); B I
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posted @ 2022-11-20 19:40 zcarl
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HDLBits-Bcdadd100问题
摘要: HDLBits-Bcdadd100问题 知识点 reg [31:0] vect; vect[ 0 +:8]; # 等同vect [7:0] vect[15 -:8]; # 等同vect[15:8] reg [0:31] vect; vect[ 0 +:8]; # 等同vect[0: 7] vect[
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posted @ 2022-11-20 00:10 zcarl
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