随笔分类 - summary
摘要：测试了reader 07版更主要的是第一次坐了高铁还不错路上看到下雨的时候都是水顺着玻璃平着流 好厉害的样子6个人去的6个人回今儿开会 老板不太满意小随意对我来说，收获感觉还是不小的，使用MP300的仪器进行了typeA和typeB的测试，typeA都是由于不清楚测试case的原因 导致的测试通不过而typeB的undershoot/overshoot的测试项 不明觉厉的样子剩下 第一天吃的松鹤楼 只能说是真不错 虽然人均差不多到了110的样子但是感觉确实对得起这个价格剩下的时候就随便吃了 第三天的金釜山自助烤肉也还不错
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摘要：昨天的那篇博文恰恰是实验室所干的事儿但是那是一种很投机取巧的方式完成的多project管理方式来看看我建立环境的方法首先，找一个比较闲的公用服务器（为什么不用自己的？有公共资源不用，你傻啊？），这里我用的是wl22这台服务器找到这个服务器上的一个闲置用户（就是没人用的账号，其实只是利用这个账号真身在这台服务器上的特性，好操作罢了）之后比如我用的是junze这个用户，要把我的svn的服务器建起来，只需要根据下面几个步骤来就好cd ~mkdir svn_rootsvnadmin create --fs-type fsfs /home/junze/svn_root/project_1svnadmin
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摘要：之前用过一次 但是没有真正的用起来 只是知道了一些基本概念好了 决定开始真正的用这个svn了参考大神http://www.cnblogs.com/wrmfw/archive/2011/09/08/2170465.html搞来搞去发现其实是建立一个svn之后把每个项目都装在这个svn目录下的不同文件夹里（也是试出来的小领悟）一切以实例为主，开始吧我的svn目录建在 /home/user/svn/下则先建立了这个文件夹后，在这下面建立svn目录结构mkdir /home/user/svnsvnadmin create --fs-type fsfs /home/user/svn之后，我以管理两个项目
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摘要：小有成就的一件事，自己纯手工，基本没有参考别人的代码，只是参考了一些思想，除了51的core用的是mentor的，其他东西都是自己和之前的自己积累下来的东西，硬件代码独立完成。框图如下：整个memory的地址映射关系如下表：PBUSROM2KX80x0000~0x07FFSRAM1KX80x2000~0x23FFEFLASH32KX80x8000~0xFFFFXBUSSRAM1KX80x3000~0x33FF比较新鲜的东西其实没有什么，memory全部使用同步逻辑的memory，加入的gpio是由于功能的需要（后面会有介绍）。只是在eflash_ctrl上多花了点心思进行调试。下面来详细说说这
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摘要：当测量一个bandgap时发现使用万用表和示波器测量的电压有出入 示波器的测量值要稍小一点 万用表的要稍大一点本来怀疑是像之前高中的时候做过的题 就说用两个同样的电压表进行测量的时候 哪个测量的电压高 说明内阻大 测量的电压更准但是后来又看了一下 不是这个问题 原来是万用表那个东西在电池供电不足的时候测量的电压就会向上偏次奥 后来又测量了一下示波器探头的直流电阻 大概是在3.2MΩ 基本就是一个电压表的量级了 也算是一个经验吧
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摘要：之前遇到一个问题测试的时候相当于将一个时钟数了1段时间之后拉一个高电平出来 比如是10M的时钟 数了40ms之后给个置高的信号但是每次都是少了一半的时间 比如10M的时钟输入 置高的信号是在数了20ms之后就变高了这个是基于一个芯片测试的小FPGA测试程序怀疑是各种问题 包括1.示波器坏了 2.信号发生器坏了 3.FPGA的IO口坏了验证1很简单 找几个时钟发生器验证一下测量的时间就知道没有问题 很容易排除验证2的时候直接观察输出的时钟频率是10M 用FPGA的拉入拉出的1个pin作为输出进行测试 也没问题验证3不太好验证 不过输入的时钟 直接输出的时候就是10M至少证明输入的时钟信号没啥“大
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摘要：近来也没干什么之前1月2日流出去的芯片回来了（其实是早就回来了）只不过一直懒着没有写总结 ╭(╯^╰)╮于是因为遗留了大量的问题 typeB非常不理想 结果就只能作罢 准备下一次流片把typeB调好 再流出去关于具体问题 一会儿另文再写再说说干嘛了吧 实验室的卡要MP了 我去 真是振聋发聩的消息 怎么说呢 我还是祝他们成功吧（笑）事情太多了 稍微分时间叙述一下首先是1月份的芯片在2月底回来的吧 1321和1301v06一起 因为主要重心还是在21上面于是 就没怎么测1301 后来又因为3月2日 TSMC35重新流了一次1321 王老师他们基本也没怎么管这个 后来COB回来 问题都反映出来了 于
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摘要：其实也没什么只是觉得装的太不容易了，都是在win32上面安装的东西。很少有详细写到在linux上面如何安装。结果我大概得搞了有一天才断断续续的从各种途径上面了解到了到底如何安装这东西真是蛋疼。好，想好要安装modelsim 10.1C的linux版本的话就开始。首先准备文件，需要的是①linux安装文件，是从eetop上面搞的linux版本下载地址http://bbs.eetop.cn/viewthread.php?tid=347327&highlight=modelsim%2B10.1②生成破解licence的工具，在上面的链接里面有 Modelsim_10.1c_crack.rar
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摘要：这里有一个小技巧，就是在nc跑前仿（包括后仿的一些情况的时候），将ncelab的权限放低的话，可以大大加快仿真的速度。将本来的+rwc换成+r就可以了，具体的解释建议还是看一下ncvlog的helper/manual。这个简单的解释摘录一下Read access is required if you want to probe objects in the design and generate an SHM,VCD, or EVCD database. This lets you use the SimVision waveform viewer to view waveforms,and
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摘要：近来陆陆续续干了些杂事，近来的事是帮助跑3X01的后仿，前面其实前仿也有问题，待我慢慢叙来。首先出现的问题是用modelsim在跑前仿的时候会出现x，感觉这是非常不合理的一种情况，因为是前仿，又不是timingchecks task导致的x，那么一定是input了x，导致这里出现了x，最后发现是mem的初始化的时候有一部分的值没有初始化，但是最后却又读到了这部分的东西，而且由于是netlist，它引入了一个带DFF的反馈的结构，就会导致这部分除了给reset外，其他情况都不会使得这个DFF脱离x状态，这样的话，当x引入的时候就会导致后面的仿真都会出现问题（真2b的testbench我只能说）这
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摘要：makefile其实不是很难的东西。干嘛用呢？主要是针对C语言里面很多的地方都要用到增量编译的过程，所以makefile自动增量编译的特性好用的很，但是我基本不用这东西，所以就是和我平常写的简单的调试nc的脚本很像的。先上代码吧还是，再慢慢讲要点吧。WORK_DIR = .VLOG_FILES = div16.v tb.vTOP_NAME = tbCOMPILER = ncvlogELABORATOR = ncelabSIMULATOR = ncsimCOMP_OPT = -64bit -messages -nocopyrightEL...
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摘要：What’s an LFSR?看了TI的一篇paper，不得不感叹，这搞模拟的公司搞起数字来，就感觉不伦不类，连个电路图都画的让我感觉蛋疼。艹，转正题先上几个要接触到的概念LFSR = linear feedback shift registerPSA = parallel signature analyzerPRPG = pseudorandom pattern generationPattern-resistant logic - logic for which the pseudorandom pattern generation technique is...
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摘要：还是来自一篇paper 分清楚case/casez/casex 在simulation/synthesis到底有什么不同我基本就是照着翻译下来，基本没啥我总结的东西，因为消化的不好首先，一般性的常识是使用casez，强烈的建议不要使用casex，（虽然我没有这个常识）。这是为啥呢？待续。首先要明确的是'?'代表的不是don't care，而是'z'。这点一定要明确。再有就是case/casez/casex其实都是可综合的，这一点也要记住。好，再说区别case treats 'z' & 'x' as it iscas
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摘要：算是转的原文 http://www.edaboard.com/thread139461.html#post604717核心就是setup time和hold timeHOLD violations are dangerous than SETUP.To keep it simple way, SETUP timing depends on the frequency of operation. But HOLD time is not.先来定义几个后面会用到的变量Tclk = Frequency of operation (can be variable)Tcq = Flop clock to
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摘要：什么叫做真正的理解setup time/hold time呢？听我道来。就是要讲明白的setup time和hold time，都知道setup time的公式是Tclk > Tcq + Tcomb + Tsetup - Tskewhold time的公式是Thold < Tcq + Tcomb - Tskew那么这两个公式是怎么来的呢？就是我要说明的问题在我下面所举的例子中，Tsetup和Thold都是针对DFF2而言的，而符号含义如下Tclk = Frequency of clockTcq = Flop clock to Flop q delayTcomb = Delay...
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摘要：+-------------------------------------------+--------------------------------------------+|任务可以有input、output和inout，数量不限； | 函数只有input参数，且至少有一个input ||-------------------------------------------+--------------------------------------------||任务可以包含有时序控制（如延时等）； | 函数不能包含有任何延迟，仿真时间为0； ||-...
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摘要：大牛就是大牛看完我又茅厕顿开了说的都是一些async FIFO的基础的东西 但是感觉这些基础的东西自己以前都是一知半解的 现在终于算是有点觉悟了当你使用同步FIFO的时候 大可以不必要弄两个counter 直接一个counter wr就+1 rd就-1，又wr又rd就hold，就完事了像我之前写的小FIFO总是拘泥于异步FIFO的圈子 弄的乱七八糟的接着 使用FIFO的时候 也可以考虑通过handshake来同步两边的pointer来进行比较 和判断full/empty 还是看应用的场合来决定 使用何种手段来搞pointer 的跨时钟域的问题之所以不用binary而用gray，这里还是考虑mu
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摘要：首先是看了PARADIGM WORKS的一篇名为《Crossing the Abyss——Asynchronous Signals in a Synchronous World》的paper吧应该是其实之前华老师很大篇幅的论文都是翻译的这篇文章里面的内容 国内的博客也有很多说的堂而皇之的话是翻译这篇文章的说的都是一些很实在的跨时钟域的基本知识 感觉看过之后有种醍醐灌顶之感首先就是基本的同步器就是两个DFF，这两个DFF在版图的时候一定要被放的非常近，以保证非常小的clock skew，再有就是第一个DFF对毛刺非常敏感 所以从原时钟域同步到新时钟域的时候 原时钟域的DFF与这个第一级的同步DF
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摘要：算是对下一步的一个小展望吧如果可能的话 一会儿就回家了王老师下一步应该还是要做一个集成MCU的reader芯片51可能是首选 正是一个熟悉51架构的好机会 如果做的话肯定要认真学习一下另一方面 如果有时间的话还是要好好看看perl 好像非常有用的样子再另一方面 看看dc综合的知识 对于真正的前端数字工程师来说 都是必要的知识 不可或缺这一阵子其实对我自己来说 提升的东西并没有多少 软件倒是写了不少 MSP430的应用 熟悉了一些 别的硬件方面的知识倒是长了没多少零零散散的帮着别人弄的filter_ctrl，osc_ctrl，再加上之前卡的test_chip上面新加的一个spi_slave配置的
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摘要：1. 用“与”操作实现快速求余运算，例如:a = a % 8;可以改为：a = a & 7;说明：位操作只需要一个指令周期即可完成，而大部分的C编译器的“%”运算均是调用子程序来完成的，代码长、执行速度慢。通常，只要是求2n方的余数，均可使用位操作的方法来代替。2.优缺点latch & Flip-Flop:-->Latch takes less area, consume less power, facilitate time borrowing or cycle stealing, not friendly with DFT tools-->Flip-flop t
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