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2022年4月12日
【项目1:uart_fsm_led】- 第二部分-tx-rx
摘要: 这部分加了接收模块,将接收和发送模块一起进行仿真验证 一、设计文件 module uart_rx #( parameter CLK_FRE = 50, //clock frequency(Mhz) parameter BAUD_RATE = 115200 //serial baud rate ???
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posted @ 2022-04-12 16:26 刘小颜
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2022年4月11日
【项目1:uart_fsm_led】- 第一部分-tx
摘要: 最近学了状态机、串口通信,于是想要使用串口通信去控制LED翻转 主要需要3个模块去实现,于是我考虑分步骤去依次实现每个模块,并且对其仿真验证 这一篇先对数据发送模块进行测试验证 设计的框图如下: 一、设计文件 module uart_tx #( parameter CLK_FRE = 50, //c
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posted @ 2022-04-11 22:30 刘小颜
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【面试】— 基础知识点
摘要: 1.50MHZ Hz是频率单位,此时表示1秒钟时钟变化50_000_000次 时钟周期:1秒/50MHz=1_000_000_000/50_000_000=20ns
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posted @ 2022-04-11 20:54 刘小颜
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【编程技巧】— 优秀的编程思路
摘要: 1.计数器的优秀编程思路 always@(posedge clk or negedge rst_n)begin if(rst_n == 1'b0) cnt <= MAX; else(cnt == MAX && flage == 1'b1) cnt <= cnt + 1'b1; else cnt <=
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posted @ 2022-04-11 19:53 刘小颜
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2022年4月10日
【HDLBit】— 刷题
摘要: 一、Getting Started 1.1 Step one module top_module( output one ); assign one = 1; endmodule 1.2 Zero module top_module(zero); output zero; assign zero =
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posted @ 2022-04-10 10:56 刘小颜
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【Verilog】— 基本语法
摘要: 符号: { } { } 有两个用途:复制、拼接 举例: 拼接 { 第1位,第2位...}:两个或多个信号拼接起来,表示一个整体的信号 //在移位寄存器中常使用下面语句实现:右移1位的操作 store <= {0, store[7:1]}; 复制 { 3 { a } }={a,a,a} //等同于 {
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posted @ 2022-04-10 10:28 刘小颜
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2022年4月9日
【协议时序】-UART- 概念
摘要: 串口通信是啥:通过FPGA的串口和其他设备进行通信,如FPGA通过串口通信,接收到PC输出的数据 金科玉律之—通信协议:串口通信想要成功发送和接收数据,必须要遵守通信协议 通信协议有啥: 起始位 数据位 奇偶校验位(可以不使用) 停止位 空闲位 uart是啥:异步串口通信,输入信号和系统时钟不同步
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posted @ 2022-04-09 20:42 刘小颜
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【3段式状态机】— 序列检测器(序列可重叠)
摘要: 序列检测器是个啥: 检测输入的一串二进制代码中,是否存在与事先设定的码组一致的代码串,检测电路输出高电平,否则输出低电平 序列检测器用在什么地方: 检测通信系统中的同步码、提取所需信号 要做的事: 使用状态机检测出一串数字序列中的指定6位数据:101011 实践: S0:IDLE S1:检测1 S2
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posted @ 2022-04-09 16:46 刘小颜
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2022年4月7日
【数电】— 框架梳理
摘要: 第二章:逻辑代数 逻辑代数的运算关系 基本运算:与、或、非 复合运算 重点:门的画法、函数的表达式、对应的真值表 逻辑函数 逻辑函数的表达方式 相互转换(电路分析和电路设计的基础) 逻辑函数的标准表达形式(最小项和的形式) 逻辑函数的化简 公式化简法 卡诺图化简法(与前面的联系:最小项、最小项之和)
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posted @ 2022-04-07 15:22 刘小颜
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【数电】— 卡诺图
摘要: 卡诺图用来干啥:化简逻辑函数(还可以用公式对逻辑函数进行化简,But 那些公式我拿到也不知道怎么用来化简) 卡诺图里面放的啥: 图里放的是最小项 让输入变量分别去控制行、列 图中逻辑相邻和位置相邻是一致的(位置相邻(卡诺图中有公共边)的两个最小项一定是逻辑相邻(只有1个变量不同)的) 怎么画嘛:行是
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posted @ 2022-04-07 13:31 刘小颜
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