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jgliu
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2018年10月13日
【接口时序】8、DDR3驱动原理与FPGA实现(一、DDR的基本原理)
摘要: 一、 软件平台与硬件平台 一、 软件平台与硬件平台 软件平台: 1、操作系统:Windows-8.1 2、开发套件:无 3、仿真工具:无 硬件平台: 1、 FPGA型号:无 2、 DDR3型号:无 二、 存储器的分类 存储器一般来说可以分为内部存储器(内存),外部存储器(外存),缓冲存储器(缓存)以
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posted @ 2018-10-13 14:20 jgliu
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2018年10月12日
【设计经验】1、Verilog中如何规范的处理inout信号
摘要: 在FPGA的设计过程中,有时候会遇到双向信号(既能作为输出,也能作为输入的信号叫双向信号)。比如,IIC总线中的SDA信号就是一个双向信号,QSPI Flash的四线操作的时候四根信号线均为双向信号。在Verilog中用关键字inout定义双向信号,这里总结一下双向信号的处理方法。 实际上,双向信号
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posted @ 2018-10-12 21:14 jgliu
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2018年9月22日
【接口时序】7、VGA接口原理与Verilog实现
摘要: 一、 软件平台与硬件平台 一、 软件平台与硬件平台 软件平台: 1、操作系统:Windows-8.1 2、开发套件:ISE14.7 3、仿真工具:ModelSim-10.4-SE 硬件平台: 1、 FPGA型号:Xilinx公司的XC6SLX45-2CSG324 2、 VGA接口 3、 液晶显示器
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posted @ 2018-09-22 16:57 jgliu
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2018年9月16日
【接口时序】6、IIC总线的原理与Verilog实现
摘要: 一、 软件平台与硬件平台 软件平台: 1、操作系统:Windows-8.1 2、开发套件:ISE14.7 3、仿真工具:ModelSim-10.4-SE 、ChipScope 硬件平台: 1、 FPGA型号:Xilinx公司的XC6SLX45-2CSG324 2、 EEPROM型号:Microchi
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posted @ 2018-09-16 15:55 jgliu
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2018年9月15日
【接口时序】5、QSPI Flash的原理与QSPI时序的Verilog实现
摘要: 一、 软件平台与硬件平台 一、 软件平台与硬件平台 软件平台: 1、操作系统:Windows-8.1 2、开发套件:ISE14.7 3、仿真工具:ModelSim-10.4-SE 4、Matlab版本:Matlab2014b/Matlab2016a 硬件平台: 1、 FPGA型号:Xilinx公司的
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posted @ 2018-09-15 15:57 jgliu
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2018年9月8日
【接口时序】4、SPI总线的原理与Verilog实现
摘要: 一、 软件平台与硬件平台 一、 软件平台与硬件平台 软件平台: 1、操作系统:Windows-8.1 2、开发套件:ISE14.7 3、仿真工具:ModelSim-10.4-SE 硬件平台: 1、 FPGA型号:Xilinx公司的XC6SLX45-2CSG324 2、 Flash型号:WinBond
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posted @ 2018-09-08 17:11 jgliu
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2018年8月25日
【接口时序】3、UART串口收发的原理与Verilog实现
摘要: 一、软件平台与硬件平台 软件平台: 1、操作系统:Windows-8.1 2、开发套件:ISE14.7 3、仿真工具:ModelSim-10.4-SE 硬件平台: 1、FPGA型号:XC6SLX45-2CSG324 2、USB转UART芯片:Silicon Labs CP2102GM 二、原理介绍
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posted @ 2018-08-25 21:05 jgliu
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2018年8月12日
【接口时序】2、Verilog实现流水灯及与C语言的对比
摘要: 一、 软件平台与硬件平台 软件平台: 1、操作系统:Windows-8.1 2、开发套件:ISE14.7 3、仿真工具:ModelSim-10.4-SE 硬件平台: 1、FPGA型号:XC6SLX45-2CSG324 二、 原理介绍 我的开发板上有4个LED灯,原理图如下: 由原理图可知仅当FPGA
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posted @ 2018-08-12 17:05 jgliu
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【接口时序】1、软件与Verilog基本格式规范说明
摘要: 一、 说明 以前总是没有记录的习惯,导致遇到问题时总得重新回忆与摸索,大大降低了学习效率,从今天开始决定改掉这个坏毛病,认真记录自己的Verilog学习之路,希望自己能一直坚持下去。 二、 软件资源与硬件资源 软件资源说明: 1、UltraEdit:本博客所有的Verilog代码全部都在UltraE
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posted @ 2018-08-12 12:45 jgliu
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