以太网温湿度采集节点硬件设计：网口电路 PCB 布线与 EMC 兼容整改方案

从原理图到PCB：以太网TCP/IP温湿度变送器硬件开发与EMC整改踩坑

 

 

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近期在调试一套工业环境监控系统时，遇到了关于 Modbus 连接保持的问题。现场部署了一批网口温湿度变送器，PoE取电、Modbus TCP上云，同时利旧接入存量RS485探头。前一篇讲了硬件电路框架和嵌入式采集开发，落地时真正拖进度的，是原理图到PCB的迭代、PoE供电稳定性，以及工业现场EMC整改。下面按开发流程展开，重点放在踩过的坑和收敛方法上。

 

 

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一、原理图阶段：别在框图层面结束

1.1 电源链设计

• PoE PD入口 → 整流桥（兼容Mode A/B）→ TVS/共模扼流圈 → PD控制器（SI3402类）→ DC-DC → 3.3V域 + 独立PHY模拟域。
• 常见错误：把PD控制器内部开关管外的外围电感、续流二极管、补偿网络照搬参考设计，未核算实际PoE分类电流。Class 1/2分类由PSE协商，PD侧应支持，但终端功耗预算要留余量，别按标称3.84W设计到边界。
• 多域供电：MCU数字域、PHY模拟域、传感器模拟域分开走线，单点磁珠/0Ω隔离，回流路径明确。PHY的AVDD与DVDD分离，退耦电容靠近引脚。

 

 

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1.2 以太网接口

• PHY选型后确认接口类型：RMII（STM32F1/F4+H7常见）或MII。RMII省引脚但时钟约束严，50MHz REF_CLK来源（外部晶振/PHY输出/MCU MCO）必须在原理图标明，不能事后飞线。
• 网络变压器：100BASE-TX用集成变压器RJ45（HR911105A类）或分立变压器+连接器。注意PHY侧端接、中心抽头偏置（LAN8720需外部3.3V经0.1μF接到抽头，部分参考设计不同），别接错VDD域。
• LED指示：PHY LED0/LED1复用配置，串联限流电阻，别直接驱动继电器。

1.3 传感与调试接口

• I2C上拉到3.3V，SHT30/HDC1080总线<10cm，多器件时ADDR引脚固定。预留测试焊盘。
• SWD+UART预留，BOOT0下拉。产线烧录用TC2030或1.27mm排针，别把SWDIO/SWCLK与功能脚冲突。
• 看门狗：外部IMP706或MCU IWDG。外部看门狗需开漏复位+电源就绪链，避免上电误触发。

二、PCB布局布线：RMII和PoE是两条高压线

2.1 叠层与分区

• 2层板能跑通但工业场景不建议。推荐4层：Top信号、GND02、PWR03、Bottom信号。PoE高压DC-DC回路在Bottom/PWR层局部铺铜，与信号层保持间距。
• 分区：PoE前端（48V悬浮域）→ DC-DC开关域 → 3.3V数字域 → PHY模拟域。开槽隔离回流不连续处，但别切断信号回流平面。

2.2 RMII布线

• REF_CLK、TXD0/1、TX_EN、RXD0/1、CRS_DV等长，组内长度差<5mm，参考平面为相邻GND层。
• 避免跨分割；时钟线包地，远离DC-DC电感和I2C。RMII信号50Ω单端控制，别串阻尼电阻后振铃。
• PHY MDIO/MDC走线短，上拉4.7k–10k，管理接口非高速但易受开关噪声耦合。

2.3 PoE/DC-DC布线

• 开关回路面积最小化：输入电容→开关管/PD控制器→电感→输出电容→回流。电感下不走过敏感信号。
• 电流能力：2oz铜厚或加铺铜，VIA双孔。PoE输入保险丝/PPTC后到桥式整流，走线载流核算。
• Y电容、共模电感放置靠近RJ45入口，TVS钳位后到PD控制器VIN。48V域与3.3V域爬电距离≥8mm（加强绝缘视设计而定），板上开槽或丝印隔离带。

2.4 传感器布板

• SHT30放板边伸出，开阻焊窗，避免自身发热。底部铺地但留导热间隙，别把DC-DC电感放探头背面。
• I2C走内层或短表层，远离开关节点。去耦100nF+1μF，VDD测试点。

三、样板调试：上电前到协议通

3.1 上电前检查

• 目视+放大镜查桥接、虚焊、极性电容方向；万用表蜂鸣查VCC-GND不短路，48V域与3.3V域不互连。
• 隔离电源供电台架：先外置稳压源给DC-DC输入，验证3.3V；再接PoE仿真器/PSE端口，验证分级和启动。
• 边界测试：输入电压范围（44–57V PSE典型），冷启动冲击电流，欠压关断回差。

3.2 启动与PHY链路

• 确认PHY复位时序、REF_CLK到位；LWIP初始化前核对netif链路状态回调。
• 常见问题：PHY没协商到100M全双工，CRS_DV采样错，RMII时钟相位问题导致RX帧错。用环回测试（PHY近回环）隔离。
• 抓包：交换机镜像口或MCU侧lwip_debug+pcap，确认ARP、DHCP/静态IP、TCP 502监听。

3.3 固件联调

• Modbus TCP从站：mbpoll读3x/4x，验证MBAP Unit ID、长度字段、异常码。
• 写回测试：保持寄存器下发采样周期/设定值，回读校验。
• 资源：LWIP pbuf池、TCP_PCB数、任务栈。多主站时代理收敛，别让SCADA直连末梢。

四、EMC整改：工业现场暴露的问题

4.1 预兼容测试现象

• CE（传导发射）：DC-DC开关频率及其谐波在150kHz–30MHz超标，尤其PoE输入端。
• RE（辐射发射）：RMII时钟50MHz及倍频、I2C扩展频谱耦合到线缆。
• EFT/Burst：信号线/以太网口注入±1kV，链路掉线、TCP RST、固件跑飞。
• ESD：接触±8kV，外壳缝隙放电后I2C锁死或PHY掉链。
• Surge：线间±1kV，PoE入口TVS击穿、PD控制器损坏。

4.2 整改踩坑

• 坑1：TVS选错。信号侧用普通TVS钳位深但结电容高，100M链路劣化；应选低结电容TVS阵列（SRV05-4类），PHY侧端接匹配别破坏。PoE入口用SMBJ58A/SMBJ60A，注意钳位电压与PD控制器耐压余量。
• 坑2：共模电感饱和。DC-DC差模电感当共模用，burst时饱和发热。信号口加共模扼流圈，PoE前端共模电感额定电流够。
• 坑3：Y电容与漏电流。金属外壳接PE后跨接Y电容引起泄漏电流超标（医疗/工业差别对待），浮地设备别盲目接壳。
• 坑4：接地弹簧片形成天线。调试飞线、测试钩子未拆，EMC测试时辐射发射陡增。量产后割掉测试焊盘。
• 坑5：软件无降级。EFT注入后LWIP连接表紊乱，未重置PHY+重绑netif。增加故障恢复：链路down回调中释放pcb、重启PHY状态机。
• 坑6：I2C受扰后SHT30锁死。SCL限流、软件复位时序，加总线恢复（9时钟脉冲），超时后重初始化。
• 坑7：机壳非金属，屏蔽缺失。塑料壳内涂导电漆或加屏蔽仓，PHY区局部屏蔽，电缆用屏蔽双绞线接大地。
• 坑8：PoE共模骚扰回灌。PSE端未隔离，长线共模电流经RJ45耦合。变压器中心抽头退耦+共模扼流圈，网线远离动力线。

4.3 收敛措施

• 滤波：DC-DC输入π型滤波，输出LC；开关频率扩频（若控制器支持）；MOSFET栅极串阻抑振铃。
• 屏蔽：PHY—变压器—RJ45最短，下方铺地并多点缝合过孔；敏感模拟区加屏蔽盖。
• 接地：单点汇接，数字地/模拟地/机壳地星型或磁珠桥接，别形成地环路。
• 固件韧性：链路抖动后指数退避重连，看门狗喂狗分区，关键寄存器定时回写，配置掉电保存。
• 验证闭环：整改后复测CE/RE预兼容 + 现场EFT台架，别只信实验室。

五、量产转产注意点

• DFM：钢网开孔、PoE焊盘热容、变压器引脚共面度。
• 校准：温湿度传感器出厂单点/双点校准，补偿偏移存EEPROM，固件读取后归一化。
• 配置模板：MAC/IP/Unit ID/映射表版本化下发，批量烧录后自检。
• 备件与回滚：固件签名OTA，回滚分区；现场替换即插即用，DHCP保留或静态分配。

六、关键词

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七、一句话总结

从原理图到PCB，开发重心不在把参考设计跑通，而在PoE供电链、RMII时钟与布线、多域电源隔离，以及工业现场EMC韧性。原理图阶段定边界，PCB阶段控回流与噪声耦合，样板阶段分域调试，EMC阶段软硬协同整改——硬件可量产的前提是实验室通、现场稳、批量一致。

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