2019年10月22日
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摘要： design seq1_b3 sta_label 0.0-1.0 0.0-1.0 1e-9 # clocks# clockID clock_name period rise_edge fall_edge sourceclockID CLK 1.0 0.0 0.5 CLK # Instance pin 阅读全文
posted @ 2019-10-22 14:33 春风一郎 阅读(753) 评论(0) 推荐(0)