摘要:
❗️此坑还没填完 最近 Chisel 改用 CIRCT 的 firtool 作为 FIRRTL 的编译后端,不仅生成 Verilog 可读性上升一大截,速度也快上不少[1]。据说新版本 VCS 也支持 Chisel 了。UC Berkey 技能树点得真是猛 来圣地巡游学习一下著名的 RocketCh 阅读全文
posted @ 2024-04-23 21:11
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摘要:
❗️此坑还没填完 TODO: GS 组成 point cloud render flow optimize 仓库结构 仓库由 C++/CUDA 和 Python 组成,CUDA 包括 diff-rasterization ,Python 包括 optimize 。CUDA 部分依赖 glm ,只用了 阅读全文
posted @ 2024-04-23 16:47
DevilXXL
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摘要:
杜书丞,目前正在香港科技大学攻读 Permanent Head Damage 学位,指导导师是 Tim CHENG 教授。对流片庞大的人物力开销深恶痛绝,每当压力超过阈值就会转换成文字宣泄出来 于是有了这个博客 lab 主页 | 知乎主页 | 领英主页 | 邮件 为什么要写博客:忙碌世界外的花园 费 阅读全文
posted @ 2024-04-23 16:44
DevilXXL
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