02 2016 档案

uart clk gen(div)
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posted @ 2016-02-25 18:00 CHIPER 阅读(2) 评论(0) 推荐(0)
uart top graphic
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posted @ 2016-02-25 16:03 CHIPER 阅读(3) 评论(0) 推荐(0)
uart top
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posted @ 2016-02-25 09:25 CHIPER 阅读(3) 评论(0) 推荐(0)
uart wrap
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posted @ 2016-02-24 21:34 CHIPER 阅读(2) 评论(0) 推荐(0)
uart software reg config file
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posted @ 2016-02-24 16:38 CHIPER 阅读(1) 评论(0) 推荐(0)
uart cdc ctrl
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posted @ 2016-02-24 13:06 CHIPER 阅读(1) 评论(0) 推荐(0)
reg clk gate(reg cgc)
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posted @ 2016-02-24 10:55 CHIPER 阅读(1) 评论(0) 推荐(0)
clk gate ctrl(cgc_wrap)
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posted @ 2016-02-23 16:47 CHIPER 阅读(2) 评论(0) 推荐(0)
uart tx/rx enable ctrl
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posted @ 2016-02-23 16:03 CHIPER 阅读(2) 评论(0) 推荐(0)
uart rx ctrl
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posted @ 2016-02-23 13:38 CHIPER 阅读(3) 评论(0) 推荐(0)
uart tx ctrl
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posted @ 2016-02-22 17:43 CHIPER 阅读(3) 评论(0) 推荐(0)
uart rx fifo
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posted @ 2016-02-22 14:53 CHIPER 阅读(2) 评论(0) 推荐(0)
setup/hold 分析
摘要：分析说明：D2：目的寄存器；D1：源寄存器； edge2：下一个时钟上升沿；edge1：当前时钟上升沿；edge0：当前时钟上升沿的前一个时钟沿；如下图： 建立时间：触发器D2（数据要到达目的的地方）在时钟上升沿edge1（以edge1是当前的时钟上升沿）输入端的数据data1（data1是 edg 阅读全文
posted @ 2016-02-20 19:32 CHIPER 阅读(1364) 评论(0) 推荐(0)
为什么会有建立时间和保持时间
摘要：何为建立时间（Setup Time）和保持时间（HoldTime）？以D触发器为例，在作为接收端时；由于工艺、寄生参数、触发器结构等原因决定，被采样数据必需有一个稳定区 间，保证数据可以正确的被触发器采样。通常我们把这个要求的稳定区间称为 Setup-Hold window。我们把 Setup-Ho 阅读全文
posted @ 2016-02-20 19:29 CHIPER 阅读(4941) 评论(0) 推荐(0)
uart tx fifo
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posted @ 2016-02-20 14:57 CHIPER 阅读(3) 评论(0) 推荐(0)
ise与win8兼容解决方案
摘要：win8中ise无法加载code，显示impact4.exe停止运行。 解决方法如下： 找到程序安装路径 1、进入文件夹 D:\Xilinx\14.6\ISE_DS\ISE\lib\nt64 把libPortability.dll重命名为libPortability.dll.orig， 把 libP 阅读全文
posted @ 2016-02-20 11:29 CHIPER 阅读(925) 评论(0) 推荐(0)
总线带宽（转整理)
摘要：关于带宽概念之前不是太熟悉，特百度，转载如下： 两种概念 如果从电子电路角度出发，带宽（Bandwidth）本意指的是电子电路中存在一个固有通频带，这个概念或许比较抽象，我们有必要作进一步解释。大家都知道，各类复杂的电子电路无一例外都存在电感、电容或相当功能的储能元件，即使没有采用现成的电感线圈或电 阅读全文
posted @ 2016-02-18 08:39 CHIPER 阅读(6343) 评论(0) 推荐(0)
AHB 总线问答（转）
摘要：<!-- h3 { margin-top: 0.19in; margin-bottom: 0.19in; direction: ltr; color: rgb(0, 0, 0); widows: 2; orphans: 2; page-break-after: auto; }h3.western { 阅读全文
posted @ 2016-02-17 23:41 CHIPER 阅读(3051) 评论(0) 推荐(0)
spis top
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posted @ 2016-02-17 16:34 CHIPER 阅读(2) 评论(0) 推荐(0)
AHB2reg 协议时序转换
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posted @ 2016-02-17 15:08 CHIPER 阅读(4) 评论(0) 推荐(0)
spis register configurate file
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posted @ 2016-02-16 15:45 CHIPER 阅读(1) 评论(0) 推荐(0)
spis cdc sync
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posted @ 2016-02-16 13:54 CHIPER 阅读(1) 评论(0) 推荐(0)
spis tx ctrl logic
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posted @ 2016-02-16 11:00 CHIPER 阅读(2) 评论(0) 推荐(0)
spis rx ctrl logic
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posted @ 2016-02-15 18:02 CHIPER 阅读(3) 评论(0) 推荐(0)
spis rxtx 逻辑（串转并、并转串）
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posted @ 2016-02-15 16:49 CHIPER 阅读(2) 评论(0) 推荐(0)
spis 框架图
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posted @ 2016-02-15 15:36 CHIPER 阅读(3) 评论(0) 推荐(0)
2016年计划
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posted @ 2016-02-15 12:03 CHIPER 阅读(6) 评论(0) 推荐(0)
cdc pl with handshake ack
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posted @ 2016-02-03 09:00 CHIPER 阅读(2) 评论(0) 推荐(0)
cdc_pl 含有lock/clear no ack
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posted @ 2016-02-02 22:04 CHIPER 阅读(1) 评论(0) 推荐(0)
cdc_short
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posted @ 2016-02-02 21:40 CHIPER 阅读(2) 评论(0) 推荐(0)
cdc3
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posted @ 2016-02-02 21:27 CHIPER 阅读(2) 评论(0) 推荐(0)
cdc2
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cdc1
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posted @ 2016-02-02 21:24 CHIPER 阅读(1) 评论(0) 推荐(0)
pluse cdc case3
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posted @ 2016-02-02 17:50 CHIPER 阅读(1) 评论(0) 推荐(0)
pluse cdc case2
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posted @ 2016-02-02 15:11 CHIPER 阅读(2) 评论(0) 推荐(0)
pluse cdc case1
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posted @ 2016-02-02 14:44 CHIPER 阅读(4) 评论(0) 推荐(0)
asyn_fifo
摘要：1 //Module Name:afifo_ctrl 2 //Description:parameterized afifo 3 4 module afifo_ctrl( 5 clk_push, 6 rst_push_n, 7 clk_pop, 8 rst_pop_n, 9 push, 10 pus 阅读全文
posted @ 2016-02-01 22:17 CHIPER 阅读(283) 评论(0) 推荐(0)
software register clock gate ip
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clock gate IP
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posted @ 2016-02-01 15:24 CHIPER 阅读(2) 评论(0) 推荐(0)
动态切换clock
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posted @ 2016-02-01 13:44 CHIPER 阅读(1) 评论(0) 推荐(0)