阿长长

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摘要： 1，后仿真中的必懂VCS仿真选项之+nospecify/+notimingcheck/ 2，notimingcheck nospecify 3，后仿中的异步D触发器设置 阅读全文

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摘要： 1，用UCLI（TCL）控制verdi dump 波形 2，使用UCLI控制VCS仿真（常用于dump波形） 3，ucli命令记录 4，ucli tcl cmd 5，浅谈VCS的两种仿真flow 阅读全文

摘要： 1，SystemVerilog中UVM库提供的一个函数uvm_hdl_deposit的用法 2，UVM及SystemVerilog中的force、deposit及两者的区别 阅读全文

摘要： 1，关于vcs的option debug_access+all的作用是啥？ 2，vcs编译选项debug_access对仿真时间的影响 阅读全文

摘要： 1，VCS&Verdi常见操作技巧一 阅读全文

摘要： 1，VCS学习(5)-Code Coverage 2，使用VCS生成覆盖率报告 3，line,tiggke,fsm,condition,branch,assert coverage 阅读全文

摘要： 1，UVM基础-组件（driver、monitor、agent...） 阅读全文