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2025年3月3日
UVM调试功能指南
摘要: UVM调试功能全解析 1. 调试功能概览 graph TD A[配置调试] --> A1[命令行跟踪] A --> A2[组件配置打印] A --> A3[资源库转储] B[工厂调试] --> B1[类型注册追踪] C[阶段调试] --> C1[相位跟踪] D[异议调试] --> D1[对象跟踪]
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posted @ 2025-03-03 21:42 LeslieQ
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2024年8月22日
使用uvm_config_db 分层Testbench配置
摘要: 前言 对于刚接触验证方法或正在采用 uvm 的工程师,本文重点介绍 uvm 配置机制 "uvm_config_db",它有助于在分层测试台组件之间传递不同的类属性。通过使用示例,本文解释了 uvm_config_db 的用法、技术和局限性。 介绍 为满足当今验证架构的需求,有必要对组件进行分层设置,
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posted @ 2024-08-22 17:49 LeslieQ
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2024年4月1日
UVM transaction 定义 方法和用法(未完)
摘要: 简介 Q1: 所有高级的基于类的验证方法都使用类来表示事务,但为什么呢?为什么不使用结构体? 1 对于高级用户而言,答案是显而易见的,但是对于新手而言,这些问题并没有在任何文献中得到解答。 2 问题是,大多数现有的 UVM 的参考指南都是由非常非常聪明的软件工程师编写的,他们假设所有用户自然知道这个
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posted @ 2024-04-01 23:59 LeslieQ
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2024年2月26日
sv断言(未完待续)
摘要: 什么是断言? 断言:断言是一种声明,即某个属性必须为真。 设计规范:请求req信号被断言后,确认ack信号必须在1到3个时钟后到达。 断言用于: 文档设计意图(例如:每个请求信号req都有一个确认信号ack) 在仿真时间内验证设计是否符合规范 验证设计假设(例如:状态值为独热码) 定位发生故障的位置
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posted @ 2024-02-26 18:57 LeslieQ
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2024年1月26日
UVM Systemverilog SystemC EDA IP国外学习网站
摘要: UVM Systemverilog SystemC EDA IP国外学习网站【转载】 SemiWiki - All Things Semiconductor! (半导体届的维基百科,罗列了各EDA,IP等供应商和行业资讯) WWW.TESTBENCH.IN Verification Academy
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posted @ 2024-01-26 10:55 LeslieQ
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2024年1月25日
sv精通1
摘要:
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posted @ 2024-01-25 21:58 LeslieQ
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ic验证基础4
摘要: 
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posted @ 2024-01-25 21:53 LeslieQ
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UVM 寄存器模型 思维导图
摘要: 
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posted @ 2024-01-25 21:50 LeslieQ
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gvim 热键图
摘要: 热键图1 热键图2 热键图3
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posted @ 2024-01-25 21:39 LeslieQ
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2024年1月22日
sv 断言
摘要: SV -- Assertions 断言【转载】 声明:该文章转载自love小酒窝(见如下链接(https://www.cnblogs.com/lyc-seu/p/12718412.html)),此处仅供查阅方便 SV -- Assertions 断言 目录 目录SV -- Assertions 断言
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posted @ 2024-01-22 10:18 LeslieQ
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