摘要： 一、HDL的概念和特征 HDL，Hard Discrimination Language的缩写，翻译过来就是硬件描述语言。那么什么是硬件描述语言呢?为什么不叫硬件设计语言呢？硬件描述语言，顾名思义就是描述硬件的语言，它用文本的形式来描述电子系统硬件结构和行为，是一种用形式化方法来描述数字电路和系统的 阅读全文

摘要： （1）竞争与冒险的概念（产生原因） ①信号在组合逻辑电路内部通过连线和逻辑单元时，都有一定的延时。延时的大小与连线的长短和逻辑单元的数目有关，同时还受器件的制造工艺、工作电压、温度等条件的影响。此外，信号的高低电平转换也需要一定的过渡时间。由于存在这两方面因素，多路信号的电平值发生变化时，在信号变化 阅读全文

摘要： 数字电路是数字IC设计的基础，而数制和码制往往又是数字电路的基础，因此数制和码制是数字IC设计基础的基础。在这里，我将记录关于数制与码制的一些主要知识点，有些知识点我是学了数电半年或者一年之后才发现，原来数电还有这样子的东西，于是整理在这里，仅供参考，有误请评论指出。 一、数制 这里不进行记录什么二 阅读全文

摘要： 本文介绍常见的电路——计数器，然后我们由计数器电路讲解到分频电路。 一、计数器 （1）计数器代码 计数器，顾名思义就是在时钟的节拍下进行计数，一个简单的N位计数器的代码如下所示，这个计数器从0计数到2^N - 1（共计数了2^N个数，也就是N位计数器）： 上述描述的计数器通过 clear 信号清除计 阅读全文

摘要： 本文记录一些关于Verilog HDL的一些技巧、易错、易忘点等（主要是语法上），一方面是方便自己忘记语法时进行查阅翻看，另一方面是分享给大家，如果有错的话，希望大家能够评论指出。 关键词： ·技巧篇： 组合逻辑输出类型选择; 语法上的变量交换; ·易忘篇： case/casex/casez语句; 阅读全文

摘要： 本文记录一下关于延迟触发器链与它的常用用法（即边沿检测。多级延迟的触发器应该是比较常用的，当我们需要对信号信号进行延时，这个时候我们就用到了延迟触发器链。下面就来记录一下吧。 一、多级延迟触发器（或延迟触发器链） （1）多级延迟触发器电路 多级延迟触发器，顾明思议就是多个触发器串在一起，对信号进行打 阅读全文

摘要： 这里来记录一下相似代码之间的不同差异，比如同步复位与异步复位触发器的对比，上升沿复位和下降沿复位的对比等等。这里主要使用ISE的综合引擎。直接附上代码和综合后电路图，有些会有部分讲解。 一、异步复位与同步复位 我在复位电路里面讲解了同步复位和异步复位的区别，这里就不详细介绍了，链接如下：http:/ 阅读全文

摘要： 前面学习了从系统级到门级的低功耗设计，现在简单地了解了一下物理级设计。由于物理级的低功耗设计与后端有关了，这里就不详细学习了。这里主要是学习了一些基本原则，在物理级，进行低功耗设计的基本原则是: ·对于设计中翻转活动很频繁的节点，采用低电容的金属层进行布线; ·使高翻转率的节点尽可能地短; ·对于高 阅读全文

摘要： 前面讲解了门级功耗的优化方法，包括静动态和总体的功耗。现在来记录一下门级层次（有点书也说是在系统级）常用的一种低功耗方法——电源门控。 ①电源门控概述与原理 电源门控是指芯片中某个区域的供电电源被关掉，即该区域内的逻辑电路的供电电源断开。电源门控(Power Gating)的设计如下图所示： 如果某 阅读全文

摘要： 三、门级电路低功耗设计优化 （1）门级电路的功耗优化综述 门级电路的功耗优化(Gate Level Power Optimization，简称GLPO)是从已经映射的门级网表开始，对设计进行功耗的优化以满足功耗的约束，同时设计保持其性能，即满足设计规则和时序的要求。功耗优化前的设计是已经映射到工艺库 阅读全文