摘要： 完成波形的随机设置（A,B任意给定高低电平即可,只是当作测试信号)，选择任务栏Assignments【Setings】,设置Simulation mode为functional,其余保持不变点击ok。点击进行编译，点击进行功能仿真，波形如下所示。 选择波形，查看Task栏目里RTL级，点击可以生成基于该波形的电路结构，通过查看该电路，验证verilog程序是否满足要求，若不满足，在打开.v文件... 阅读全文