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2018年5月18日
Verilog仿真时钟
摘要: 一、变量初始化 变量初始化的基本原则为:可综合代码中完成内部变量的初始化,Testbench中完成可综合代码所需的各类接口信号的初始化。 初始化的方法有两种:一种是通过initial语句块初始化;另一种是在定义时直接初始化。 当initial语句块中有多条语句时,需要用begin…end或者fork
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posted @ 2018-05-18 07:57 伊凡凡正在学IC
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2018年2月2日
如何用vcs输出fsdb格式的波形
摘要: 由于Verdi只能查看fsdb格式的波形,而vcs可以生成供DVE查看的vpd格式波形,如果想要输出fsdb格式的波形,我们就要额外在testbench中加入两个函数,并且用相应的命令进行编译。 1.首先了解一些vcs的常用命令: -cm line|cond|fsm|tgl|obc|path 设定c
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posted @ 2018-02-02 16:08 伊凡凡正在学IC
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如何更换gvim配色方案
摘要: 1.查看你的系统中自带的有哪些配色方案,在shell中执行命令: ls -l /usr/share/vim/vim70/colors/ 可以看到列出的方案,我们以“desert”方案为例。 2.在你的家目录下创建.vimrc,内容如下: set tabstop=4 set softtabstop=4
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posted @ 2018-02-02 11:55 伊凡凡正在学IC
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