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摘要： 在verilog使用过程中,产生以下几个问题 wire 和 reg 的语义是什么,有什么不同? 阻塞赋值和非阻塞赋值的语义是什么? assign 和 always 语义是什么? 弄清语义是为了正确的使用,不仅是结果正确,比如有时候可能两种写法得到的结果是一样的但是从语义来看会有一种是更适合当前语境的 阅读全文

摘要： 简单记一下方便需要的时候看 设计模式原则 总原则: 开闭原则--对扩展开放,对修改关闭 单一职责 里氏替换 -- 任何基类可以出现的地方，子类一定可以出现 依赖倒置 -- 依赖于抽象而不依赖于具体 接口隔离 -- 类间的依赖关系应该建立在最小的接口上 最少知道 -- 只和朋友交谈 首先要减少非必要的 阅读全文